具有掺杂的缓冲区的过渡金属氧化物电阻开关式器件的利记博彩app

背景

1.领域

本文所述的开关式器件的实施方案涉及集成电路存储器，并且特别是涉及包含表现出电阻变化的材料的非易失性集成电路存储器的形成。

2.问题阐述

非易失性存储器是一类集成电路，其中存储单元或元件在提供给该器件的电源被关闭之后不会失去其状态。电阻开关式存储器是其中活性元件是在电阻状态和导电状态之间改变状态的材料的存储器。已经提出了许多不同的电阻开关式存储器。参见stephanlai，“currentstatusofthephasechangememoryanditsfuture”，intelcorporation,researchnotern2-05(2005)；2006年5月2日授权给darrellrinerson等人的美国专利第7,038,935号；2005年6月7日授权给terryl.gilton的美国专利第6,903,361号；2005年1月11日授权给shengtenghsu等人的美国专利第6,841,833号；2003年9月23日授权给hyun-takkim等人的美国专利第6,624,463号；b.j.choi等人，“resistiveswitchingmechanismsoftio2thinfilmsgrownbyatomic-layerdeposition”，journalofappliedphysics98,033715(2005)；jae-wanpark等人，“reproducibleresistiveswitchinginnonstoichiometricnickeloxidefilmsgrownbyrfreactivesputteringforresistiverandomaccessmemoryapplications”,j.vac.sci.technol.a23(5),9月/10月，2005；i.h.inone等人，“nonpolarresistanceswitchingofmetal/binary-transition-metaloxides/metalsandwicheshomogeneous/inhomogeneoustransitionofcurrentdistribution”,arxiv:cond-mat/0702564v.1，2007年2月26日；以及2010年11月16日授权给s.bradherner的美国专利第7,834,338号。这些文献都没有公开在非易失性存储器必须工作的正常电压、电流、时间和温度下稳定的电阻开关式元件。

更稳定的存储器公开于2009年12月29日授权给jolantacelinska、mathewd.brubaker和carlosa.pazdearaujo的标题为“stabilizedresistiveswitchingmemory”的美国专利第7,639,523号；2011年1月18日授权给carlosa.pazdearaujo、jolantacelinska和mathewd.brubaker的标题为“correlatedelectronmemory”的美国专利第7,872,900号；以及2010年8月17日授权给mathewd.brubakercarlosa.pazdearaujo和jolantacelinska的标题为“non-volatileresistanceswitchingmemoriesandmethodsofmakingsame”的美国专利第7,778,063号。虽然这些存储器是稳定的，但是这样的存储器的许多实例使用了通常不在互补金属氧化物半导体(cmos)存储器中使用的元件，例如铂电极。由于许多集成电路制造设施利用cmos制造工艺，因此更难以将这些存储器商业化。此外，市售存储器制造商常常有它们用于电极、金属化等的优选材料。因此，非常希望具有ceram非易失性电阻开关式存储器和与许多不同制造工艺(包括cmos技术)兼容的用于制造这种存储器的工艺。

概述

在实施方案中，电阻开关式存储器包括：第一电极和第二电极；在所述第一电极和所述第二电极之间的活性电阻转换区，所述电阻转换区包含过渡金属氧化物和包含配体的掺杂剂，所述掺杂剂具有第一浓度；在所述第一电极和电阻转换材料之间的第一缓冲区，所述第一缓冲区包含所述过渡金属氧化物和所述掺杂剂，其中所述掺杂剂具有大于所述第一浓度的第二浓度。在一个替代方案中，所述第二浓度可以是所述第一浓度的两倍或更多。在另一替代方案中，所述第一缓冲区可比所述活性电阻转换区厚。在又一替代方案中，所述第一缓冲区可是所述活性电阻转换区的至少1.5倍厚。任选地，所述存储器还可以包括在所述第二电极和所述电阻转换区之间的第二缓冲区。或者，所述掺杂剂可以包含配体。或者，所述配体可以包含碳，包括碳的化合物。在另一替代方案中，所述活性电阻转换区可以是40纳米厚或更小。任选地，所述活性电阻转换区可以是30纳米厚或更小。或者，所述活性电阻转换区可以是20纳米厚或更小。任选地，所述活性电阻转换区可以是10纳米或更小。

在实施方案中，制造电阻开关式存储器的方法包括：形成第一电极和第二电极；在所述第一电极和所述第二电极之间形成活性电阻转换区，所述电阻转换区包含过渡金属氧化物和包含配体的掺杂剂，所述掺杂剂具有第一浓度；和在所述第一电极和电阻转换材料之间形成第一缓冲区，所述第一缓冲区包含所述过渡金属氧化物和所述掺杂剂，其中所述掺杂剂具有大于所述第一浓度的第二浓度。在一个替代方案中，所述形成第一缓冲区可以包括沉积包含所述过渡金属和所述掺杂剂的前体。在另一替代方案中，所述前体可以是液体前体或固体前体，例如w(co)6。或者，所述沉积可以选自mocvd、旋涂、浸渍、液体源雾化沉积、升华和原子层沉积(ald)。如果使用固体前体，则可以通过升华沉积。任选地，所述前体可以包括0.2mol或更少的所述掺杂剂。或者，所述前体可以包括0.1mol或更少的所述掺杂剂。所述方法的实施方案还可以包括在所述第二电极和所述电阻转换区之间形成第二缓冲区。所述方法可以包括在互补金属氧化物半导体(cmos)工艺中。

实施方案还包括钙钛矿型结构例如raox的电阻开关式元件，其中a包括ni、ti和/或其它过渡金属；且r包括y、la、yb、pr、nd和/或其它稀土元素。所述电阻开关式元件还可以包括例如co和羰基化合物的配体，该配体稳定过渡金属在配位化合物中的价态。所述电阻开关式元件还可以包括具有不同厚度和不同的过渡金属络合物和co配体的多个层。

在其他实施方案中，电阻开关式元件包括具有各种导电层厚度与活性层厚度比率的同质结或异质结。同质结可以包括夹在过饱和或导电nio的第一区域与过饱和或导电nio的第二区域之间的ytiox的活性区。异质结可以包括夹在过饱和nio的第一区域与过饱和nio的第二区域之间的ytiox的活性区。在这里，过饱和nio是指高掺杂的nio或其它过渡金属氧化物，其中掺杂剂是外在配体co(羰基)或氧化物中过渡金属的碳酸根(carbonelates)。配体可以是其它配体，例如氨、硫化物、氟化物、亚硝酰基(nitosyl)络合物、硒络合物和类似的络合物。

本文描述的存储器的实施方案不仅提供了在正常电压、电流、时间和温度下稳定的电阻开关式存储器(非易失性存储器必须在正常电压、电流、时间和温度下操作)，而且还提供了可以在常规集成电路制造工艺(如cmos工艺)下制造的这类存储器。此外，所述存储器的实施方案是纯量子力学存储器，因为导电状态和电阻状态之间的转变是量子力学的。当结合附图阅读时，本发明的许多其它特征、目的和优点将从下面的描述变得显而易见。

附图简述

从结合附图阅读的以下详细说明将更清楚地理解上述特征，其中：

图1描绘了具有多个存储单元的集成电路的一个实施方案；

图2是图1的集成电路的存储单元沿线2-2的截面图；

图3是存储单元的一个实施方案的图示；

图4是对于九个不同的存储单元面积如图3中的nio(6+1+3)存储单元的电流(以安培为单位)与偏压(以伏特为单位)的关系图；

图5示出了在两个不同的偏压频率下面积为10微米×10微米的nio(6+2+3)存储单元的电荷(以库仑为单位)与偏压的关系图；

图6示出了在两个不同的偏压频率下面积为10微米×10微米的nio(6+1+3)存储单元的电荷(以库仑为单位)与偏压的关系图；

图7是在没有缓冲区的情况下ytiox存储单元的首次八次扫描的作为纵坐标的电流(以安培为单位)与作为横坐标的偏压(以伏特为单位)的关系图；

图8示出了ceram的器件结构的一个实施方案；

图9示出了利用转移掺杂的器件结构的数个实施方案；

图10示出了具有ni:w(co)6的数个多层器件结构的实施方案，其中冒号后的材料表示用来掺杂ni的材料，在这种情况下为六羰基钨，即具有六个羰基的钨；

图11示出了没有回复退火的nio:w结构的电流测量结果(以安培为单位)与偏压(以伏特为单位)的关系；

图12示出了未回复退火的备选的nio:w结构的电流测量结果(以安培为单位)与偏压(以伏特为单位)的关系；

图13和14示出了在不同的快速退火条件下数种不同器件结构的初始电流的测量结果(以毫安为单位)与器件面积(以平方微米为单位)的关系；和

图15至18示出了各种不同的三层结构的各种测量结果。

已经阅读本公开的本领域技术人员在遵循上述附图的同时，应当理解这些结果，因为所使用的符号类似于用于上述附图的符号；但是，一个新符号示于图15和16，这个符号是在如ytiox/a/ytiox/ytiox中的两条斜线之间的“a”，该符号表示在沉积“a”两侧的两个层之间进行退火。

详述

近年来，对利用可用于快速转换(飞秒级)的纳米级现象的介观器件(mesoscopicdevice)给予了很大的关注。对于表现双稳态非易失性存储状态的器件，这种关注尤为急切。本文描述的结构、系统和方法的实施方案提供了将转换现象的建模和计算组合的框架。本文公开的基础物理学使非易失性存储器领域前进到所谓的互补金属氧化物半导体(cmos)中并超出了闪存非易失性存储器。还提供了器件中的活性区的新途径的更好理解，在该器件中能够以受控方式发生量子相转变。这种在工艺上指定其中快速转换和存储行为可以在约5nm的厚度中发生的活性区的能力是本发明的新特征。通过采用在过渡金属氧化物(tmo)的配位化合物中使形式价态稳定的技术，可以产生通过取代配体如羰基“掺杂”的可控制的特别限定的区域；并且金属/绝缘体转变中的转换和存储现象可以在纳米级水平上受控制，而不需要现有技术的电阻存储器的当前的“细丝(filament)”典范。当被隔离到远离金属触点的特定受控区域中时，由电压(能量)驱动的这种纯粹的mott或电荷转移(chargetransfer)量子相转变产生了存储转换功能，该功能可以被纯粹视为是被mott在理论上预测的类型的电荷歧化反应的结果。

本文描述的结构、系统和方法的实施方案产生了有价值的新现象区域，其立即有用的并且在技术上意义重大。由于本发明人减小了这些器件的规模，发生了已经在介观传输文献中理论化的几件事情。例如能带的能级离散化、带宽调制以及通过相互作用的电子区域传输的现象，虽然在理论上预期，但从未成为行业工具，原因是使用这些现象的器件不可得。与现有技术的半导体器件相比，了解这些新型器件中的像mott样转变区域的关系是有用的。至于现有技术半导体工业，活性区的隔离对于可靠的器件操作是基本的。许多体相区域的隔离是电阻存储器中的基本物理步骤，正如在半导体(或金属/半导体和mos结)的第一p-n结中它是重要的一样。简单来说，在具有像mott样现象的可逆区附近具有掺杂材料的永久导电区域的能力提供了新的技术解决方案，同时提供了可以进行许多计算值实验的实验室。

本文所述的系统的实施方案提供了过渡金属单氧化物nio，其易于通过ni(co)4掺杂的技术上重要的步骤来控制。通过在碱性nio中引入该配体制备的器件可以使其完全导电或能够维持金属/绝缘体转变。nio区厚度为30nm/5nm/30nm的金属/导电nio/活性转换区(导电或非导电nio)/导电nio/金属的简单“三明治”显示出能量窗口的极好控制(0.6ev/1.2ev)，引起金属至绝缘体侧的电子密度相转变(0.6ev)以及绝缘体至金属侧的弹道介观传输(ballisticmesoscopictransport)。此外，缺少与金属的直接相互作用减少甚至似乎完全屏蔽了氧化物/金属界面中的空间电荷区域；即，这些区域被导电nio屏蔽。实验证据清楚地表明，这些界面是欧姆性的，并且当活性区被设置在绝缘体状态时，电荷波动被消除，从而允许活性区自由地经历相转变。

相转变的触发机制的基础可以是从导电nio区向活性区中的热离子注入。当隔热层可靠时，会发生电子波函数的较高相干性。因此，当克服1.2ev屏障时，通过活性区中密度驱动的相转变所产生的普遍存在的栅效应(gatingeffect)来引起弹道传输。由于相转变比从阴极侧注入的电荷的漂移速度快得多，所以阳极局部电子密度引发每个3d轨道中的获得排斥性hubbardu(库仑排斥)的临界占有(occupation)数。通过这种内部库仑排斥，带隙打开，在nio的情况下，作为mott绝缘体的电荷转移类型，小于u的电荷间隙成为主要屏障，该屏障涉及3d(nio)-2p(氧)相互作用。因此实现了具有巨大技术价值的可逆且可靠的飞秒级存储器件。

物理学价值对于nio不是唯一的。事实上，在过渡金属氧化物、钙钛矿和超导体中旋转、旋转/轨道耦合和其他现象可以在介观和纳米尺度上使用这种人为的空间隔离相来理解。所有固态电子器件都是基于亚稳定的转换和应当在至少两个状态下稳定和可逆的存储器来工作的。一般来说，对抗温度波动在零偏压下完全稳定时，滞后现象是所有非易失性存储器的基础。在当前闪存存储器情况下，已经发现由于电荷捕获而造成的人造滞后现象和捕获有其限制，因为电荷存储变得非常小并且浮动栅极中的电子数目将低于100。

对这个问题的答案包括基于铁电和铁磁迟滞的存储器。材料的不相容性和加工温度现在已经推动了该行业在其电阻滞后中利用这些过渡金属氧化物。在我们特别且独特的本申请中，由于绝缘体的软击穿，滞后并非来自细丝形成。这是对像mott样相转变有目的的物理驱动的的控制。已经示出了从4k到150℃的这种相转变的证明。此外，在零偏压下的存储状态下，已经确定了在300℃下的保留(retention)。

我们已经表明，外在配体如羰基配体的作用可能对所有过渡金属是共同的。其他配体也是有效的。稍后本申请在表1中公开了一百多种配体的列表。

这里主要讨论的过渡金属是镍和钒。其他过渡金属及其配体包括在刚刚提到的列表中。然而，可以使用任何过渡金属。此外，上述专利还公开了，金属向绝缘体的相转变也可以发生在通过将过渡金属与例如硫化物、碘化物和碲化物的材料体系组合而制备的化合物中。广义来讲，这也适用于将过渡金属与硒的化合物结合，硒位于碲和硫之间并具有相似的性质。这些材料的实例是包括与含碳配体组合的过渡金属的硫属化物。作为一个实例，单硫属化物具有式tme[其中tm是过渡金属，e是硫(s)、碘(i)、碲(te)和硒(se)]，与co组合，其可以写为tme:co。这可以通过将单硫属化物前体与过渡金属羰基前体组合，即tme+tmx(co)y来合成。另一个实例是具有式tme2的二硫属化物，其可以通过将tme2与相关的金属羰基化物结合形成，例如在nis2+ni(co)4中。羰基化物在材料中的包含将与任何包含过渡金属的硫属化物一起起作用。差不多存在数以百计、甚至千计这样的材料以及如上所述的数百种可能的配体，并且根据以下详细说明将本公开扩展到超出本文的预期范围。现在足以说这里公开的缓冲层概念应该适用于它们中的全部。

包括过渡金属的硫属化物可以通过在其生产中简单包含外在配体(如碳或羰基)而转化为ceram材料，该公开内容将对相变存储器(pcm)研究产生重大影响。pcm的某些性质可能导致这项研究转向有意思但非生产性的方向。作为一个实例，通过生产金属细丝，对pcm施用高电场可以突然将高电阻玻璃转变成优良的导体。这可能是由于这些材料中的金属简单地沿着电场的路径熔化以形成细丝。然而，细丝形成具有元素随机性，具有高度局部性，且细丝不稳定。相比之下，加入外在配体(如碳和羰基)，产生在整个材料中均匀的稳定的歧化(disproportionation)条件。

当配位球体被稳定化并远离缺陷和空间电荷区域时，会最佳地发生导致稳定的ceram材料的歧化作用。本公开实现了这一目标。随着全球电阻存储器经过了十年竞争，我们现在能够将行业转移到完全cmos兼容的nio器件。这是重要的，因为低于65nm的所有半导体器件现在都使用可能采用仅450℃的加工温度的硅化镍。由于本文描述的nio器件可以在400℃下合成，所以它已经与纳米尺度cmos相容。

现在将参考以下描述的结构、系统和方法的具体实施方案。应当理解，无意对结构、系统和方法的范围进行限制。还应理解，所公开的结构、系统和方法的实施方案包括对所示例说明的实施方案的改变和修改，并且包括本文描述的原理的进一步应用，这点如本领域技术人员通常想到的那样。

图1示出了具有多个存储单元102、104和106的示例性集成电路110，其优选地布置成行(例如109)和列(例如107)。集成电路110还可以包括其他集成的架构结构112、114。架构结构例如存储单元102等和其它结构112、114优选地形成在半导体衬底120上，半导体衬底120优选为硅，但也可以是其他材料，例如锗或镓。

图2是通过图1的线2-2截取的存储单元106的截面图。存储单元106包括半导体120、底部电极124、缓冲区126、电阻转换活性区130、缓冲区134和顶部电极140。优选地，电极124和140是导电材料，例如金属或掺杂的多晶硅。可以使用的金属的实例包括铂、铝和钛。活性区130是过渡金属氧化物，例如氧化镍或氧化钇钛。优选地，活性区130是ceram材料，其是掺杂有一种或多种使ceram材料稳定化的外在配体的过渡金属氧化物。如本领域已知，过渡金属氧化物包括内在配体，即氧。外在配体是参与过渡金属离子的配位球的非氧的元素或化合物。

优选地，稳定化通过直接金属-外在配体键，虽然外在配体也可以与内在配体键合。碳是外在外在配体元素的一个实例，和氨是外在配体化合物的一个实例。外在配体的额外细节在2009年12月29日授权给jolantacelinska、mathewd.brubaker和carlosa.pazdearaujo的标题为“stabilizedresistiveswitchingmemory”的美国专利第7,639,523号中公开。缓冲区126和134也是ceram材料，优选是与活性区130相同的材料，不同之处在于掺杂度更高。例如，区域130可以掺杂有0.1摩尔量的外在配体材料，例如碳，而区域126和134掺杂有0.2摩尔量的外在配体材料。区域126和134可以具有不同量的掺杂剂，或相同量的掺杂剂。在一些实施方案中，仅存在区域126和134中的一个，而在其它实施方案中，存在两者。尽管区域124、126、130、134和140被示出为具有大致相同的厚度，但优选它们各自具有不同的厚度。

图3是存储单元150的一个实施方案的图示说明。存储单元150包括半导体衬底154(优选半导体晶圆)、底部电极154、顶部电极164、电阻转换活性区160和缓冲区158。该具体实施方案意在示出具有单个缓冲区、以及区域160和158的相对厚度的的存储单元的一个示例性实施方案。在该实施方案中，区域158是高配体摩尔浓度材料的相对较厚的区域，在这种情况下为富碳材料，该材料优选是导电的。在该讨论中，“富”是指相对于区域160。区域160示出了低配体摩尔浓度材料的区域，在这种情况下为低碳。这里，“低”是指与区域158的关系。在该具体实施方案中，配体是碳。优选地，区域160与区域158相比相对较薄。优选地，电极164和156是导电材料，例如金属或掺杂的多晶硅。可以使用的金属的实例包括铂、铝和钛。应当认识到，这里的图1至图3和图8没有描述实际的集成电路或集成电路元件，且不是按比例绘制，而是如专利附图领域公知，仅仅是理想化的图示以更好地解释结构、系统和方法的要素。虽然这些区域表示为垂直堆叠，但是这些区域也可以是水平层，或者在其他构架上。下面将讨论在实际存储单元150上进行的电测量。

为了简洁地描述电阻开关式存储单元，例如150，将使用如下所述的描述性符号。形成存储单元，做法是，使用nio加配体前体的旋涂沉积，随后烘烤，然后通过快速热退火(rta)，优选在450℃以100℃/秒的速率进行。烘烤每个旋涂层，随后形成下一个区域。本文使用的nio加配体前体使得在退火之后0.2摩尔浓度的前体的一个旋涂层通常为10nm厚并且0.1摩尔浓度的前体的一个旋涂层为5nm厚。因此，如果例如沉积三层0.2摩尔浓度的旋涂前体，则将产生总厚度为30nm的区域；并且如果沉积两层0.1摩尔浓度的旋涂前体，则将产生总厚度为10nm的区域。参考图2，已经开发的符号指定底部缓冲区126的层数，其后是活性区130的层数，其后是顶部缓冲区134的层数。数字用“+”号分开。缓冲区可以用0.2摩尔浓度的前体制成，而活性区可以用0.1摩尔浓度的前体制成。因此，符号nio(6+2+3)表示这样的存储单元，其具有由六层0.2摩尔浓度的前体制成的底部缓冲区126，其为60nm厚，由两层0.1摩尔浓度的前体制成的活性区130，其厚度为10nm，和由三层0.2摩尔浓度的前体制成的顶部缓冲区134，其厚度为30nm。作为另一个实例，符号nio(3+1+2)表示这样的存储单元，其具有由三层0.2摩尔浓度的前体的旋涂层制成的30nm厚的底部缓冲区126，由一层0.1摩尔浓度前体的旋涂层制成的0.5nm厚的活性区130，和由两层0.2摩尔浓度的前体的旋涂层制成的20nm厚的缓冲区134。

图4是九个不同的存储单元面积的如图3中的nio(6+1+3)存储单元的最初扫描的电流(以安培为单位)与偏压(以伏特为单位)的函数关系图。该存储单元与图5中测量的相同，不同之处在于活性转换区仅为一个在退火后为5nm厚的旋涂区。曲线280是面积为222×222μm²的存储单元的曲线，曲线284是面积为133×133μm²的存储单元的曲线，曲线286是面积为89×89μm²的存储单元的曲线，曲线288是面积为44×44μm²的存储单元的曲线，曲线292是面积为20×20μm²的存储单元的曲线，曲线289是面积为15×15μm²的存储单元的曲线，曲线290是面积为10×10μm²的存储单元的曲线，曲线296是面积为7.5×7.5μm²的存储单元的曲线，曲线294是面积为5×5μm²的存储单元的曲线。对于活性区较厚的器件，结果是类似的，不同之处在于电流略高且边缘效应较小。

图5示出了在两个不同的偏压频率下面积为10微米×10微米的nio(6+2+3)存储单元的首次扫描的电荷(以库仑为单位)与偏压的关系图。电极是铂。曲线300和302在10千赫(khz)下测量，曲线304和306在1兆赫兹(mhz)下测量。这些曲线表明，对于正电压和负电压两者，电荷与电压的关系都是双稳态的并且是线性的，这是存储器的例外反应。

图6示出了在两个不同的偏压频率下对于面积为10×10平方微米的nio(6+1+3)存储单元的电荷(以库仑为单位)与偏压(以伏特为单位)的关系图。电极是铂。曲线310、314、316和318在10千赫(khz)下测量，曲线322和324在1兆赫兹(mhz)下测量。1mhz测量结果与图5的结果相似，但10khz测量结果是非线性的。这是由于在10khz下测量装置表现出界面效果。

图7是在没有缓冲区和铂电极的情况下ytiox10×10μm²存储单元的首次八次扫描的电流(以安培为单位)与偏压(以伏特为单位)的关系图。纵坐标为对数坐标。

本文讨论的薄膜或ceram材料通过液体沉积工艺沉积，优选其中将碳引入到材料中的工艺。这些工艺包括mocvd(金属有机蒸气相外延)、旋涂、浸渍、液体源雾化沉积、原子区沉积(ald)、其他csd(化学溶液沉积)方法，或通过沉积金属然后用存在于大气中的碳供体化合物将其氧化。在优选的方法中，金属有机前体被沉积并反应以形成所需的材料。辛烷是过渡氧化物前体的优选溶剂。根据本发明的存储单元如下制成。衬底120可以是具有氧化硅涂层的硅晶圆。可以烘烤衬底以除去任何水分。同时，可以准备好ceram前体。前体包含适于在沉积和加热时形成可变电阻材料的金属部分。例如，如果氧化镍是所需的可变电阻材料，则前体将包含镍。前体可以是包含碳的液体，并且可以是金属有机前体。这可能是从化学公司(例如日本东京的kojundochemicalco.)购买的现成的前体；或者可以在临沉积之前准备前体。沉积底部电极124，所述电极可以包括本领域已知的粘附区域和/或阻挡区域。所述电极可以是铂。然后，可以形成区域124、126和134。为了形成这些区域中的每一个，可以沉积前体，可以通过旋涂沉积前体；但可以以上述其他方式沉积。沉积之后，可以加热前体以形成结晶材料。在一个实施方案中，加热过程包括烘烤过程和退火过程。然而，可以使用各种各样的加热过程，包括在热板上烘烤、炉退火、快速热处理(rtp)[有时称作快速热退火(rta)]或使膜结晶的任何其它过程。晶圆上沉积的前体可以例如在热板上被烘烤，并且可以在100℃和300℃之间的温度下进行1分钟至10分钟的时间。可以在不同的温度下使用两次烘烤；第二次烘烤可能处于较高的温度。沉积和烘烤步骤可以根据需要重复多次以获得所需的膜厚度。在沉积和干燥所有层之后，将干燥的层退火以形成结晶膜，例如126、130或134。退火可以在450℃至650℃的温度下，例如，较低温度下，时间为20分钟至1小时。退火可以在氧气或包含所需配体的气体中进行。然后，在形成所有的ceram区域之后，可以沉积顶部电极140。这可能是铂。然后，将顶部电极和ceram材料图案化，例如通过干蚀刻，例如通过用氩离子研磨。然后可以进行回复退火(recoveryanneal)，该退火可以在450℃至650℃的温度下进行，并且可以持续30分钟至1.5小时的时间，并且可以在氧气中进行。然后可以完成集成电路以将ceram材料130作为活性元件包括在集成电路中。这里，“活性元件(activeelement)”是指响应于电流或电压的施加而变化的元件，与钝化绝缘体相反。

这里描述的实施方案的原理也可以应用于其它电阻转换材料，例如钙钛矿型结构例如raox的电阻开关式元件，其中a包括ni、ti......和其它过渡金属；且r包括la、y、pr、nd、y和其他稀土元素。电阻开关式元件还可以包括例如co和羰基的配体，该配体稳定过渡金属的配位化合物中的价态。电阻开关式元件还可以包括不同厚度和不同过渡金属络合物和co配体的多个层。本文描述的实施方案的原理可以进一步应用于包括具有各种导电层与活性层厚度比的同质结或异质结的电阻开关式元件。同质结可以包括夹在过饱和或导电nio的第一区域和过饱和或导电nio的第二区域之间的ytiox的活性区。异质结可以包括夹在过饱和nio的第一区域和过饱和nio的第二区域之间的ytiox的活性区。这里，过饱和nio是指高掺杂的nio或其它过渡金属氧化物，其中掺杂剂是外在配体co、羰基(carbonylradical)或氧化物中的过渡金属的碳状态(carbonstates)。配体可以是其它配体，例如氨、硫化物、氟化物、亚硝酰基(nitosyl)络合物、硒络合物和类似的络合物。

可用于解释一个ceram器件400的一些特征的结构在图8中示出。在该实例中，ceram器件400包括在两个外部金属导体406和420之间的ni(co)4掺杂的nio氧化镍的三层薄膜，即402、414和418。活性材料414夹在nio的两个膜402和418之间，用作缓冲电极或阻挡层。这两个缓冲膜406、418被掺杂以使其具有非常高的导电性并且用于匹配电极，而中心芯活性膜414是具有不同的较低水平的类似掺杂的氧化镍。在一个实施方案中，缓冲层402的厚度为约20纳米(nm)，活性层414(其包括区域410)为约10至20nm厚，缓冲层418为约20nm厚，电极406和420之间的器件总厚度约为60nm厚。阻挡层402和422发挥许多重要的作用。它们向活性材料提供欧姆接触，更重要的是，移开由外部电极引起的任何像肖特基(shottky)阻挡状的效应和任何不需要的表面状态远离活性材料电极界面；表面状态可能会妨碍器件的作用。掺杂的nio阻挡层402和418总是从活性层414传导任何屏蔽电极效应。操作中，正是中心区域414经历在导电和绝缘状态之间的可逆金属绝缘体转变(mit)，该量子相转变可以在接近阳极的区域410中开始。在区域408中发生局部的单一位置氧化还原事件。一旦转变，活性区414能够保持在任何状态长达所需要的时间长度，该能力是其作为非易失性(nv)存储器的潜在用途的基础。在本段落和其他地方，术语“掺杂”可以在通俗意义上用于描述一种可以改变nio结构的机制，应当理解，浓度水平可能高于与常规单晶硅中的供体或受体掺杂相关的浓度水平。

图9示出了转移掺杂的实例。转移掺杂是指通过具有配体例如羰基单元(co)的另一种过渡金属化合物来添加配体例如(co)n，该配体具有大于或等于主体(host)过渡金属氧化物的外在配体例如羰基化合物的n。如图9的第一行所示，在这种情况下与(co)n组合的过渡金属x可用于为过渡金属氧化物(tmo)提供外在配体材料(外在配体为co)。由于外在配体具有一个氧，提供转移掺杂的过渡金属可以具有大于1的n。提供额外的外在配体的过渡金属可以是铅、钽、铌、钨或大多数任何其它过渡金属。例如，我们知道nio是内在配体是氧的主体化合物。镍的羰基化合物是ni(co)4。因此，在这种情况下，期望在可以使用的溶液转移掺杂中具有更多的co。这里，“溶液”是指初始液体溶液或在热处理或退火之后的固溶体。

图9的第3行示出了转移掺杂的一种用途。由于化合物ni(co)4是非常有毒的，为了得到更多的co，优选使用基于碳的金属有机溶液或升华将六羰基钨[w(co)6]添加到nio中。这使用w(co)6nio的缓冲层、nio的转换层(具有外在配体co)和w(co)6nio的另一缓冲层来实现。结果是，退火后的固体主体的内部有一些碳或羰基(co)，并且现在具有来自六羰基钨的更多的羰基。虽然钨本身可能增加或可能不增加样品的导电性，但是通过转移掺杂，六羰基钨产生导电性。换句话说，添加到主体中的带羰基的过渡金属相对于导电性的变化几乎是惰性的，然而，由于co通过直接连接金属的σ键向ni贡献一个或多个电子的反馈机制(backdonationmechanism)，六个单元的co通过金属和能量低于镍金属的氧轨道之间的2-p键接收回两个电子。在该过程中，费米能级，即整个系统的最高占用电子能级朝向“价带”降低，更准确地说，朝向“下部hubbard价带”降低，这使得nio更加p型和空穴导体。因此，转移掺杂是使主体更加p型的方式，可用于ceram的复位操作。

这可以扩展到在相同主体中的具有不同部分或量的多种类型的基于羰基的化合物，因此几乎独立于σ掺杂来调节费米能级，σ掺杂负责所需的歧化反应，该歧化反应导致响应周围电子密度的屏蔽效果的mott转换的发生。当然，这种电子密度在“set”电压下增加，在“reset”电压下降低。作为另一个实例，图9的第四行示出了用于ceram器件的制剂，其类似于第三行的用于ceram器件的制剂，在缓冲层中ytio3替代了nio。在图9的第五行示出了另一种变体，其中缓冲层与第三行的实例相同，但是活性层是ytio3而不是nio。

图9所示的实例示出了nio和ytiox作为主体氧化物。然而，任何过渡金属氧化物(tmo)和钙钛矿(例如srtio3等)可以将(co)x作为配体。因此，我们可能具有包括非均相层和均相层的不同层。例如，我们可以使用nio/ytio3(含碳)/nio，我们也可以放置中性的tmo如富含(co)并因此富含碳的w(co)6来制得如nio(w(co)6)/ytio3(含碳)/nio(w(co)6)的多个层。

类似地，我们已经发现稀土(re)材料可以用在例如图9的第1行的制剂中，其中n大于1；即，已经制备了例如retio3/retio3/retio3、renio3/renio3/renio3或renio3/retio3/renio3和其他这类变体的器件，其中每个层具有不同的摩尔浓度并且每个层包括(co)x配体例如(co)6。已经制备了使用retio3和renio3的器件，其中re可以是y、sc、la、pr、yb、eu和其他稀土元素。在这里，我们理解，y、yb和eu在技术上不是稀土元素；但是这些材料通常包括在稀土列表中，原因是这些材料通常发现与稀土元素一起存在于天然存在的矿藏中。我们还发现pbniox中的转换不属于任何现有的文献，它是一种真正的新材料。因此，所述材料可以假设为a(+2)nio，也可以假定为a(+2)tio。

图10比较了具有ni:w(co)6的数种可能的多层器件结构，其中冒号后面的材料表示用来掺杂ni的材料，在这种情况下是具有六个羰基的钨；这个符号也将在下文使用。图10首先示出了两个不同但相关的结构，nio/nio:w/nio(其编号为结构1)和nio:w/nio/nio:w(其编号为结构2)。在该图中，我们使包括六羰基钨的层变为粗体以提请注意这么一个事实，在结构1中，六羰基钨在转换层中；而在结构2中，六羰基钨在缓冲层中。应当理解，每个w包括(co)6作为外在配体。活性层(中间层)和缓冲层二者均由三个旋涂层制成，如符号3/3/3所示。应当理解，如上所述，中间层具有较低的摩尔浓度。1号器件的厚度为750埃，2号器件的厚度小于750埃。1号和2号器件在a、b、c和d条件下制成，其中a表示回复退火，b表示在450℃下炉快速退火，c表示在450℃下的快速热退火(rta)；且d表示650℃的rta。对1号和2号器件进行测试以显示通过使用nio:w(co)6的导电机制控制。在晶圆1a的中心活性层为掺有w(co)6且未回复退火的nio，晶圆1a最初为on并且在面积小于15×15平方微米的情况下表现出低电阻短路。对于5×5平方微米的器件在1毫安的限制电流下，它还显示为off。它具有约1.4伏特的vsetpf，具有低分散和稳定的循环。在晶圆2a的中心活性层为nio并且缓冲层均为掺有w(co)6且未回复退火的nio，晶片2a被证明是更导电的，对于面积大于7.5平方微米的器件其具有低电阻的短路。对于5×5平方微米的器件，该器件表现出70毫安的初始电流。对于5×5平方微米的器件，它具有较高的off，其限制电流为2毫安。vset约为1.6伏特，具有较高的vset和vreset分散。总体而言，2号器件比1号器件更为导电；a型器件比b、c和d型器件更为导电。

图11至图18示出了根据本发明的集成电路器件的测量结果，以说明ceram器件的性质。在这些图中，符号w代表六羰基钨。

图11示出了不同面积的nio/nio:w/nio结构的电流(以安培为单位)与偏压(以伏特为单位)的测量结果，其中活性层和缓冲层中的每个由三个旋涂层形成且未回复退火。所有器件最初都on，对于大于或等于15×15平方微米的面积，具有低电阻短路。换句话说，不可能使器件复位，因为它们太导电。这是由于测试器件的0.1安培限制。如果测试器件可以在更高的电流下运行，则可以使器件复位。

图12示出了未回复退火的nio:w/nio/nio:w结构的电流(以安培为单位)与偏压(以伏特为单位)的测量结果，其中活性层和缓冲层中每个由三个旋涂层形成。所有器件最初都为on，对于大于或等于7.5×7.5平方微米的面积，具有低电阻短路。将图11的曲线与图12的曲线相比，可以看出，在缓冲层中具有六羰基钨的器件通常更具导电性。

图13示出了在不同快速退火条件下nio/nio:w/nio器件的初始电流(以毫安为单位)与器件面积(以平方微米为单位)的测量结果。在该图中，ra表示回复退火，fra表示炉回复退火，rta表示快速热退火。如前所述，w代表六羰基钨。图14示出了在上述同样的不同快速退火条件下nio:w/nio/nio:w器件结构的初始电流(以毫安为单位)与器件面积(以平方微米为单位)的测量结果。比较图13和图14，我们发现结果是相似的，不同之处在于缓冲层中具有六羰基钨的器件再次更具导电性。

图15和16示出了具有不同面积的各种三层结构的电流(以安培为单位)与偏压(以伏特为单位)的测量结果；已经阅读本公开的本领域技术人员在遵循上述附图的同时，应当理解这些结果，因为所使用的符号类似于用于上述附图的符号；但是，一个新符号是在ytiox/a/ytiox/ytiox中的两条斜线之间的“a”，该符号表示在沉积“a”两侧的两个层之间进行退火。每个层由具有羰基掺杂的ytiox形成，尽管中间层的羰基摩尔浓度较低，即，与缓冲层的0.16摩尔浓度相比为0.1摩尔浓度。最后也将器件退火。退火在450℃的炉中进行30分钟。器件的厚度为500埃。在图15中，纵坐标是线性坐标，但在图16中，纵坐标是对数坐标。在这些实例中，除了大于或等于44平方微米的器件之外，所有器件都初始为on并可复位。

图17和18示出了具有不同面积的各种三层结构的电流(以安培为单位)与偏压(以伏特为单位)的测量结果。每个层由具有羰基掺杂的ytiox形成，尽管中间层的摩尔浓度较低，即，与缓冲层的0.16摩尔浓度相比，为0.1摩尔浓度。在每种情况下，器件最初都是on。大于或等于7.5平方微米的器件具有低电阻短路。在图17中，纵坐标是线性坐标，但在图18中，纵坐标是对数坐标。

另一个发现是，材料可以是p型材料，使得空穴产生了金属向绝缘体转换的条件，相比较而言，绝缘体向金属的转换通过隧穿效应实现。一般来说，所有碱性氧化物在其天然状态可以是p型的(这对于所有的钙钛矿，甚至sbt、pzt和其它铁磁材料也是如此)。nio是p型的，而ta2o5和hfo2不是。因此，在这些后述材料中未发现该效果。用空穴或电子对带填充在根本上是在两个状态之间的“摇椅”。这表明我们可以通过掺杂使得为n型的tmo成为p型tmo；这可以是可以提供ceram转换的p型材料。

各种金属的一些有用配体如表1所示。在该表中，感兴趣的金属以粗体表示，随后是金属与感兴趣配体形成的络合物的式子。

表1

铝

[ai(oh)4]^-

[aif6]^3-

镉

[cd(cn)4]^2-

顺-cd(nh3)4cl2

反-cd(nh3)4cl2

铬

cr(acac)3

[cr(cn)6]^4-

[cr(en)3]³⁺

[crf6]^4-

[cr(nh3)6]³⁺

[cr(oh2)6]³⁺

[cro4]^2-

顺-cr(acac)2(oh2)2

反-cr(acac)2(oh2)2

顺-[cr(nh3)4cl2]⁺

反-[cr(nh3)4cl2]⁺

[cr(nh3)5br]²⁺

[cr(nh3)5ci]²⁺

[cr(nh3)5(oso3)]⁺

顺-[cr(oh2)4cl2]⁺

反-[cr(oh2)4cl2]⁺

[cr(oh2)5br]²⁺

[cr(oh2)5ci]²⁺

[cr2o7]^2-

钴

[cobr4]^2-

[cobr6]^4-

[coci4]^2-

[co(cn)6]^3-

[co(en)3]³⁺

[cof6]^3-

[co(nh3)6]²⁺

[co(nh3)6]³⁺

[co(oh2)6]²⁺

[co(o3c)3]^3-

cis[co(en)2cl2]+

反-[co(en)2cl2]+

顺-[co(oh2)4(scn)2]⁺

反-[co(oh2)4(scn)2]⁺

顺-[co(nh3)4cl2]⁺

反-[co(nh3)4cl2]⁺

顺-co(nh3)4(no2)2

反-co(nh3)4(no2)2

顺-co(nh3)4(ono)2

反-co(nh3)4(ono)2

顺-[co(ox)2(oh2)2]^-

反-[co(ox)2(oh2)2]^-

顺-[co(en)2(no2)ci]⁺

反-[co(en)2(no2)ci]⁺

[co(nh3)5ci]²⁺

[co(nh3)5(no2)]²⁺

顺-[co(nh3)br(en)2]²⁺

反-[co(nh3)br(en)2]²⁺

铜

[cu(cn)2]^-

[cu(nh3)4]²⁺

[cu(oh2)6]²⁺

顺-[cu(en)2(oh2)2]²⁺

反-[cu(en)2(oh2)2]²⁺

金

[au(cn)2]^-

铁

[fe(ci4)^-

[fe(cn)6]^3-

[fe(cn)6]^4-

fe(co)5

[fe(edta]^2-

[fe(en)3]³⁺

[fe(oh2)6]²⁺

[fe(oh2)6]³⁺

[fe(ox)3]^3-

[fe(scn)6]^3-

顺-[fe(en)2(no2)2]⁺

反-[fe(en)2(no2)2]⁺

[fe(oh)(oh2)5]²⁺

锰

[mnci6]^4-

[mn(cn)6]^3-

[mn(cn)6]^4-

[mn(en)3]²⁺

[mn(oh2)6]²⁺

[mno4]^-

汞

[hgs2]^2-

[hgci3]^-

[hgl4]^2-

钼

[moo4]^2-

镍

[nibr4]^2-

[ni(cn)4]2-

ni(co)4

[ni(en)3]²⁺

[ni(nh3)4]²⁺

[ni(nh3)6]²⁺

[ni(oh2)6]²⁺

[ni(ox)2]^2-

[ni(penten)]²⁺

顺-ni(en)2ci2

反-ni(en)2ci2

钯

[pdci4]^2-

铂

[ptci4]^2-

[ptcl6]^2-

[ptci6]^4-

[ptl4]^2-

[ptl6]^2-

[pt(nh3)4]²⁺

pt(en)ci2

顺-pt(nh3)2cl2

反-pt(nh3)2cl2

顺-pt(nh3)2ci4

反-pt(nh3)2ci4

pt(nh3)2(ox)

[pt(nh3)3br]⁺

反-[pt(nh3)4cl2]²⁺

顺-[pt(nh3)4cl2]²⁺

顺-[pt(nh3)4i2]²⁺

反-[pt(nh3)4i2]²⁺

铼

[reo4]^-

铑

[rhcl6]^3-

[rhi2(co)2]^-

cis[rh(phen)2ci2]+

钌

[ru(nh3)6]²⁺

[ru(phen)3]²⁺

[ru(nh3)5cl]²⁺

银

[ag(s2o3)2]^3-

[ag(nh3)2]⁺

锡

[snci6]^2-

[sn(oh)6]^2-

[sn(oh)3]^-

钛

[tio]²⁺

钒

[v(en)3]³⁺

[vo]²⁺

[vo2]⁺

[voci4]^2-

锌

[zn(cn)4]^2-

[zn(nh3)4]²⁺

已经描述了具有大存储窗并且与cmos加工兼容的电阻开关式存储器。应当理解，在附图中示出并在本说明书中描述的具体实施方案是出于示例的目的，不应当解释为不必要地限制下面的权利要求。此外，显而易见的是，在不脱离本发明构思的情况下，本领域技术人员现在可以对所描述的具体实施方案进行众多使用和修改。同样很明显，在许多情况下所记载的方法可以不同的顺序执行；或等同结构和方法可以代替所描述的各种结构和方法。应当理解，本文所述的每个特征和要素可以与任何其它特征和要素组合。