专利名称：具有低歪斜的对称差分输出信号的轨到轨共模操作的高速差分接收机的利记博彩app
技术领域：
本发明涉及差分接收机电路领域，更具体地，涉及具有低歪斜(skew)和对称的差分输出信号的轨到轨(rail to rail)共模操作的差分接收机电路。
用于接收具有轨到轨共模电压(CMV)范围的低摆幅差分信号的一种传统的技术是利用两个接收机电路。第一接收机电路例如是一个被使用来接收具有接近于电源电压电位(Vdd)的CMV的信号的NMOS型输入晶体管；和一个被使用来接收具有接近于地电位(gnd)的CMV的信号的PMOS型输入晶体管。来自两个接收机电路的输出信号然后被组合而成为来自它的输出端的单端输出信号。差分接收机电路典型地具有任何形式的差分放大器，然而，最通常的差分放大器典型地是高度精确的折叠的级联放大器。
美国专利申请No.5,801,564公开了一种减小歪斜的差分接收机，它利用了第一和第二差分放大器。不幸的是，为了得到预定的运行，需要两个差分放大器的仔细的耦合。另外，这个电路相当复杂，结果，影响差分输出信号中产生低歪斜和对称性。
所以，需要以低的设计成本提供一种具有低歪斜和对称差分输出信号的高速性能差分接收机。因此，本发明的目的是提供一种以轨到轨共模工作而同时提供低歪斜和对称的差分输出信号的差分接收机电路。
按照本发明，提供了一种差分接收机电路，包括作为第一轨的第一电源电压端，用于接收第一电位；和作为第二轨的第二电源电压端，用于接收低于第一电位的第二电位；差分信号分离器，包括被布置在第一和第二电源电压端之间的第一分支和第二分支，和用于接收差分输入信号的第一和第二输入端，以及用于提供来自这些输入端的两个互补的差分输出信号的第一到第四输出端；共模电压(CMV)归一化级，用于对这两个互补的差分输出信号进行电乎移位，以形成一个互补的差分输出信号，CMV归一化级包括与该差分信号分离器级的第一到第四输出端有电耦合的第一到第四输入端和第一和第二输出端；跨阻抗放大器，包括与CMV归一化级的第一和第二输出端有电耦合的第一和第二输入端和用于提供具有低信号歪斜和对称性的轨到轨互补差分输出信号的第一和第二输出端，其中差分信号分离级、共模电压(CMV)归一化级和放大器被布置在第一和第二电源电压端之间，以用于接收来自这些电源电压端的第一和第二电位。
按照本发明，提供了一种用于提供差分输出信号的方法，包括提供作为第一轨的第一电压和作为第二个另外的轨的第二个另外的电压；接收一个具有共模电压(CMV)和不同于从第二电压到第一电压的轨到轨的差分输入信号；把该差分输入信号进行相位分离以使其成为具有交叉电压和在电位上不是重叠而是相互有间隔的两个互补的差分输出信号；把该两个互补的差分输出信号进行电平移动，并把每个互补差分信号内的模拟信号相加，以形成一个与轨到轨不同的互补的输出信号；以及放大该一个互补输出信号，以形成一个具有类似于电平移位信号的时间特性轨到轨互补差分信号和在第一与第二电压之间的近似地从轨到轨的转换。
按照本发明，提供了一个电路，它包括用于提供第一电压作为第一轨和第二个另外的电压作为第二个另外的轨的装置；用于接收一个具有共模电压(CMV)和与从第二电压到第一电压的轨到轨不同的差分输入信号的装置；用于对差分输入信号进行相位分离，以使其成为具有交叉电压和在电位上不相重叠而是相互间有间隔的两个互补的差分输出信号的装置；用于把该两个互补的差分输出信号进行电平移位以及把在每个互补差分信号内的模拟信号相加，以形成一个与轨到轨不同的互补的输出信号的装置；以及用于放大该一个互补输出信号以形成一个轨到轨互补差分信号，该信号具有类似于电平移位信号的时间特性和在第一与第二电压之间的近似地从轨到轨的转换的装置。
按照本发明，提供了用于存储指令数据的贮存媒体，该指令数据包括第一指令数据，用于提供作为第一轨的第一电压和作为第二个另外的轨的第二个另外的电压；第二指令数据，用于接收具有共模电压(CMV)且不同于从第二电压到第一电压的轨到轨的差分输入信号；第三指令数据，用于对差分输入信号相位进行分离以使其成为两个互补的差分输出信号，该信号具有交叉电压并且在电位上不是重叠而是互相隔开；第四指令数据，用于把两个互补的差分输出信号进行电平移动以及把在每个互补差分信号内的模拟信号相加以形成一个与轨到轨不同的互补的输出信号；以及第五指令数据，用于放大该一个互补输出信号，以形成轨到轨互补差分信号，该信号具有类似于电平移位信号的时间特性和在第一与第二电压之间的近似地从轨到轨的转换。
现在结合以下的附图描述本发明的示例性实施例，其中
图1a显示作为轨到轨共模电压(CMV)差分接收机电路的第一级的差分信号分离器输入级；图1b显示作为轨到轨CMV差分接收机电路第二级的CMV归一化级；图1c显示作为轨到轨CMV差分接收机电路第三级的跨阻抗放大器级；图1d显示作为轨到轨输出驱动器级的缓冲器级，它是轨到轨CMV差分接收机电路的第四级；图2a用图形显示提供给轨到轨CMV差分接收机电路的差分输入端的、小的差分信号输入信号“in+”和“in-”；图2b显示由于“in+”电压上升的结果，“dn”电压增加和“sn”电压减小；图2c显示由于“in+”电压上升的结果，“sp”电压减小和“dp”电压增加；图3a显示从第二级的输出端提供的输出信号“in2-”和“in2+”；图3b显示从第三级的输出端提供的输出信号“in3-”和“in3+”；以及图3c显示从轨到轨CMV差分接收机电路的输出端提供的输出信号“out-”和“out+”。
图1a到1d显示按照本发明的优选实施例的轨到轨共模电压(CMV)差分接收机电路100的多个级。差分接收机电路100包括串联地布置的四级对称电路。图1a显示作为第一级的差分信号分离器输入级110。图1b显示第二级，即CMV归一化级130。图1c显示第三级，即跨阻抗放大器级150。图1d显示第四级，它作为轨到轨输出驱动器级150的缓冲器级。
参照图1a，第一级110包括两个对称电路分支，第一分支111和第二分支112。布置在第一分支111内的是第一n沟道金属氧化物半导体(NMOS)晶体管(NMOS1)113和第一p沟道金属氧化物半导体(PMOS)晶体管(PMOS1)114。布置在第二分支112内的是第二NMOS晶体管(NMOS2)115和第二PMOS晶体管(PMOS2)116。四个被标记为R1的电阻负荷117a到117d把器件NMOS1 113、PMOS1 114和NMOS2 115、PMOS2 116的漏极和源极电耦合到第一和第二电源电压端110c和110d，它们分别被连接来接收电位电压Vdd和Vss。
晶体管PMOS1 114和NMOS2 115的栅极被电耦合在一起，并与被标记为“In+”的第一输入端110a电耦合。晶体管PMOS2 116和NMOS1113的栅极一起与被标记为“In-”的第二输入端110b电耦合。第一和第二输入端110a和110b形成第一级110的差分输入端。第一级110另外还具有四个输出端110e到110h，分别被标记为inn1，inp1，inn2，inp2，用于从那里提供各个信号dn，sn，sp，dp。
在使用中，第一级110用作为差分信号相位分离级。被提供给这一级的差分输入端110a和110b的输入信号是具有轨到轨共模电压(CMV)的约50mv到400mv的电位的小的差分信号。
第一分支111包括NMOS1和PMOS1器件113和114，它们以穿过栅极结构的形式被电耦合在一起。这个穿过栅极的每一端被电耦合到各自的电阻，其中电阻117a和117b分别把NMOS1和PMOS1器件113和114的漏极和源极电耦合到110c和110d电源电压端。电阻117c和117d用来分别把NMOS2和PMOS2器件115和116的漏极和源极耦合到110c和110d电源电压端。
参照图2a，这个图用图形显示当小差分信号“In+”和“In-”被施加到输入端110a和110b--即MOS器件113和114的栅极端一时发生的情形。当“In+”上升时，PMOS1器件114导通较小的电流，而对于NMOS1器件113，出现同样的但反向的情形。对于输入端110b，因为信号“In-”的电位降低，NMOS1器件113导通较小的电流。总的效果是要增加穿过栅极阻抗，所以传播通过这个第一分支111的电流减小。如图2b所示，对于输出端110e和110f，由于“in+”电压上升的结果，将观察到“dn”电压的增加和“sn”电压的减小。
同样类型的事件在第二分支112中观察到，但其效果与第一分支111的效果相反。参照图2c，“in+”电压上升的这个转变导致“sp”电压的减小和“dp”电压的增加，正如在110g和110h输出端是观察到的。图2d显示对于这个第一级110从各个输出端110e和110h提供的四个叠加的输出信号dn，sn，sp，dp。这个图还显示以一个差分信号开始，导致生成两个互补的差分信号，它们具有在上部与下部的交叉点组(被标记为“A”，201a和201b与“B”，202a和202b)之间的大约几皮秒的非常小的歪斜。而且，当输入CMV改变时，相应的交叉电压有电位的上升或下降，但在时间上或在定时关系上保持相对恒定。另外，当差分幅度改变时，两个互补差分输出信号的差分幅度也改变。
回到图1a，当输入CMV移到较高的Vdd电位时，即使在PMOS1器件114关断或接近关断时，穿过栅极结构也使电流导通。当输入CMV移到地电位时，即使在NMOS1器件113关断或接近关断时，穿过栅极结构也使电流导通。
所以在CMV移到更高的Vdd或更低的Vss的极端情形下，仍由一个MOS器件，(它是NMOS1器件113或PMOS1器件114)执行差分相位分离。在极端CMV的情形下，当第一分支111比起第二分支112导通更多的电流时，差分相位分离由轨到轨CMV来起作用。
任选地，这个第一级的差分增益小于1，这时它任选地是差分输入电压的50％。优选地，在集成电路制作期间，每个PMOS和NMOS器件113到116以及电阻117a 117d的尺度这样选择以使得交叉电压和差分相位分离的最好性能接近最优。
回到图1b，CMV归一化级被显示为具有两个NMOS器件，其标记为MN1 134和MN2 136，以及两个PMOS器件，其标记为MP1 133和MP2135。器件MP1 133和MP2 135的漏极被电耦合在一起，并且还被电耦合到第一电源电压端130c，用于通过电阻R2 137a接收Vdd。器件MN1134和MN2 136的源极被电耦合在一起，并且还被电耦合到第二电源电压端130d，用于通过电阻R2 137b接收Vss。第三电阻R3 137c布置在一个被形成在器件MP1 133的源极与器件MN1 134的漏极之间的接点与一个被形成在器件MP2 135的源极与器件MN2 136的漏极之间的接点之间。
PMOS器件MP1 133和MP2 135的栅极端形成第二级130的输入端130e和130f，并且被分别电耦合到第一级底侧的输出端110f和110h。NMOS器件MN1 134和MN2 136的栅极电耦合到第一级顶侧的输出端110e和110g。这个第二级是互补差分级，它用来把共模电压(CMV)归一化到大约Vdd/2。
参考图3a，当被提供给输入端130e的输入电压“inp1”低于被提供给输入端130g的输入电压“inp2”时，和当被提供给输入端130f的输入电压“inn2”高于被提供给输入端130h的输入电压“inn1”时，正电流路径从节点131a(如由信号“in2-”所表示)经过电阻R3 137c流到节点131b(如由信号“in2+”所表示)。主电流路径被形成为从第一电源电压端130c，电阻R2 137a，经过晶体管MP1 133，经过电阻R3 137c，经过晶体管MN2 136，经过电阻R2 137b，和最后到第二电源电压端130d(它是地电位Vss)。
当输入条件被颠倒时，出现相反的情形。正的电流从节点131b，“in2+”经过电阻R3流到节点131a，“in2-。优选地，PMOS和NMOS器件133，135，134，136被设计成具有相等的工作面积和可比较的增益gm。这使第一级110的电容负荷得以均衡，以及有助于从这个第二级130的输出端131a和131b提供的输出信号的歪斜与对称性。根据对于晶体管MP1 133，MP2 135和MN1 134，MN2 136的相等的增益gm，流入电阻R3 137c的正的和负的电流是相等的。所以，从第二级130的输出端131a和131b提供的输出差分电压的中心值约为Vdd/2的CMV。而且，因为第二级130主要被使用来把CMV归一化，这一级的电压增益并不重要。电压增益在第三级150实现。
而且，对于图3a，随着第一级110的差分输入CMV的改变，从输出端110e到110h提供的四个输出信号的电位上下移动。参考图3b，当从输出端131a和131b提供的第二级130差分输出信号的差分幅度改变时，它的CMV保持为恒定的--约Vdd/2。
回到图1c和1d，这些图显示跨阻抗级。第二级的输出端131a 131b被电耦合到输入端150a和150b，信号“in2+”和“in2-”是从第三级150的这些端提供的。跨阻抗级150包括具有各自的反馈负荷电阻157a和157b的两个倒相器，即第一倒相器151和第二倒相器152。每个电阻R4 157a和157b提供从倒相器输出端到倒相器输入端150a或150b的负反馈，从而把每个倒相器的正常的高增益从几百或几千降低到小的数值，诸如5。这个跨阻抗级150的净效应在于，它产生具有相等的上升和下降时间的输出波形，如果提供给输入端150a和150b的差分输入信号处在技术规范内的话。这个第三级150形成第二级130的电阻负荷，因为根据定义，提供给跨阻抗级输入端150a和150b的输入信号具有电流的形式。
参考图3b，因为牵涉到短路电流或通过电流，从跨阻抗级150的输出端150c和150d提供的输出信号“in3+”和“in3-”不是轨到轨的。实际上，跨阻抗级150给第二级130加上额外的电流负荷，以及提供对于第二级130附加的CMV均衡。另外，由于跨阻抗级150的输出信号由电路设计所控制，从输出端150c和150d提供的信号“in3+”和“in3-”是具有非常低歪斜的对称差分信号，并以Vdd/2为中心，但不是轨到轨的。参照图3c，随着第一级110的差分输入CMV改变，第三级150的差分输出信号的差分幅度会改变，但它的CMV保持恒定，约为Vdd/2。
参照图1d，第四级配备有两个输入端170a和170b，它们被耦合到第三级150的输出端150c和150d。这个第四级170接收来自第三级150的输出信号，以及通过使用缓冲器电路171和172缓冲该输出信号，以便在输出端170c和170d上形成输出信号“out+”和“out-”。参照图3d，最终得到的输出信号“out+”和“out-”是轨到轨的。根据设计，这个第四级170被优化以放大和缓冲第三级150输出信号和保留波形和CMV的低的歪斜和上升与下降对称性。
有利地，按照本发明的实施例的差分接收机能够以高速度或任选地以低速度进行差分信号放大和信号通信，其中低歪斜和高对称性是优选的。
可以设想许多其它实施例而不背离本发明的精神或范围。
权利要求
1.一种差分接收机电路，包括作为第一轨的第一电源电压端(110c；130c)，用于接收第一电位；和作为第二轨的第二电源电压端(110d；130d)，用于接收低于第一电位的第二电位；差分信号分离器(110)，包括被布置在第一电源电压端(110c)和第二电源电压端(110d)之间的第一分支(111)和第二分支(112)，和用于接收差分输入信号的第一输入端(110a)和第二输入端(110b)，以及用于提供来自这些输入端的两个互补的差分输出信号的第一到第四输出端(110e，110f，110g，110h)；共模电压(CMV)归一化级(130)，用于对两个互补的差分输出信号进行电平移位，以形成一个互补的差分输出信号，该CMV归一化级(130)包括与差分信号分离器级(110)的第一到第四输出端(110e，110f，110g，110h)有电耦合的第一到第四输入端(130e，130f，130g，130h)和第一和第二输出端(131a，131b)；跨阻抗放大器(150)，包括与CMV归一化级(130)的第一和第二输出端(131a，131b)有电耦合的第一和第二输入端(150a，150b)，以及用于提供具有低信号歪斜和对称性的轨到轨互补差分输出信号的第一和第二输出端(150c，150d)，其中差分信号分离级(110)、共模电压(CMV)归一化级(130)和跨阻抗放大器(150)被布置在第一电源电压端(110c；130c)和第二电源电压端(110d；130d)之间，用于接收来自这些电源电压端的第一和第二电位。
2.按照权利要求1的差分接收机电路，包括缓冲器级(170)，它包括第一输入端(170a)和第二输入端(170b)，它们电耦合到跨阻抗放大器(150)的第一输出端(150c)和第二输出端(150d)；以及第一输出端(170c)和第二输出端(170d)，用于提供轨到轨互补差分输出信号。
3.按照权利要求1的差分接收机电路，其中第一分支(111)包括具有栅极、漏极和源极的第一PMOS器件(114)；具有栅极和与第一PMOS器件(114)的漏极和源极电耦合的漏极和源极的第一NMOS器件(113)。
4.按照权利要求3的差分接收机电路，其中第二分支(112)包括具有栅极、漏极和源极的第二PMOS器件(116)；具有栅极和与第二PMOS器件(116)的漏极和源极电耦合的漏极和源极的第二NMOS器件(115)，其中第一PMOS器件(114)和第二NMOS器件(115)的栅极被电耦合在一起和形成差分信号分离级(110)的第一输入端(110a)以及第二PMOS器件(116)和第一NMOS器件(113)的栅极形成差分信号分离级(110)的第二输入端(110b)。
5.按照权利要求4的差分接收机电路，其中NMOS(113，115)器件和PMOS器件(114，116)包括近似相等的工作面积和近似相等的增益。
6.按照权利要求4的差分接收机电路，其中第一分支(111)包括第一组两个近似相同的电阻(117a，117b)，它们分别被布置在被电耦合的第一NMOS(113)器件和第一PMOS(114)器件的漏极与第一电源电压端(110c)之间和在被电耦合的第一NMOS(113)器件和第一PMOS(114)器件的源极与第二电源电压端(110d)之间，其中差分信号分离级(110)的第一输出端(110e)和第二输出端(110f)分别在第一NMOS(113)器件与第一PMOS(114)器件的被电耦合的漏极与源极处形成。
7.按照权利要求6的差分接收机电路，其中第二分支(112)包括近似等同于第一组两个大体相同的电阻(117a，117b)第二组两个近似相同的电阻(117c，117d)，它们分别被布置在被电耦合的第二NMOS(115)器件和第二PMOS(116)器件的漏极与第一电源电压端(110c)之间和在被电耦合的第二NMOS(115)器件和第二PMOS(116)器件的源极与第二电源电压端(110d)之间，其中差分信号分离级(110)的第三输出端(110g)和第四输出端(110h)分别在第二NMOS(115)器件与第二PMOS(116)器件的被电耦合的漏极与源极处形成。
8.按照权利要求1的差分接收机电路，其中共模电压(CMV)归一化级(130)包括第一分支；第二分支；以及在两个分支的第一端到第一电源电压端(130c)之间的第一电阻耦合(137a)和在两个分支的第二端到第二电源电压端(130d)之间的第二电阻耦合(137b)，其中用于第一电阻耦合(137a)与第二电阻耦合(137b)的电阻值近似相等。
9.按照权利要求8的差分接收机电路，其中共模电压(CMV)归一化级(130)的第一分支包括第一PMOS器件(133)，它具有与CMV归一化级(130)的第一输入端(130e)电耦合的栅极、被电耦合到第一分支的第一端的漏极、和源极；以及第一NMOS器件(134)，它具有与CMV归一化级(130)的第二输入端(130f)电耦合的栅极、被电耦合到第一PMOS器件(133)的源极的漏极以便形成CMV归一化级(130)的第一输出端(131a)、和被电耦合到第一分支的第二端的源极。
10.按照权利要求9的差分接收机电路，其中共模电压(CMV)归一化级(130)的第二分支包括第二PMOS器件(135)，具有与CMV归一化级(130)的第三输入端(130g)电耦合的栅极、被电耦合到第二分支的第一端的漏极、和源极；以及第二NMOS器件(136)，具有与CMV归一化级(130)的第四输入端(130h)电耦合的栅极、被电耦合到第二PMOS器件(135)的源极的漏极以便形成CMV归一化级(130)的第二输出端(131b)、和被电耦合到第二分支的第二端的源极。
11.按照权利要求10的差分接收机电路，其中NMOS器件(134，136)和PMOS器件(133，135)包括近似相等的工作面积和近似相等的增益。
12.按照权利要求1的差分接收机电路，还包括第三电阻(137c)，被布置在CMV归一化级(130)的第一输出端(131a)与第二输出端(131b)之间。
13.按照权利要求1的差分接收机电路，其中跨阻抗放大器(150)包括第一倒相器电路(151)，被布置在跨阻抗放大器(150)的第一输入端(150a)与第一输出端(150c)之间；以及第四电阻(157a)，被布置成与第一倒相器电路(151)并联。
14.按照权利要求13的差分接收机电路，其中跨阻抗放大器包括第二倒相器电路(152)，被布置在跨阻抗放大器(150)的第二输入端(150b)与第二输出端(150d)之间；以及第四电阻(157b)，被布置成与第二倒相器电路(152)并联。
15.按照权利要求2的差分接收机电路，其中缓冲器级(170)包括第一缓冲器电路(171)，被布置在缓冲器级(170)的第一输入端(170a)与第一输出端(170c)之间。
16.按照权利要求15的差分接收机电路，其中缓冲器级(170)包括第二缓冲器电路(172)，被布置在缓冲器级(170)的第二输入端(170b)与第二输出端(170d)之间。
17.按照权利要求1的差分接收机电路，其中差分输入信号具有约50mv到400mv的电位，以及具有轨到轨的共模电压(CMV)。
18.按照权利要求2的差分接收机电路，包括同一个集成电路半导体基片，其中差分信号分离器(110)、CMV归一化级(130)、跨阻抗放大器电路(150)和缓冲器级(170)被合并在同一个集成电路半导体基片上。
19.一种提供差分输出信号的方法，包括提供作为第一轨的第一电压和作为第二个另外的轨的第二个另外的电压；接收具有共模电压(CMV)和不同于从第二电压到第一电压的轨到轨的差分输入信号；把差分输入信号进行相位分离以使其成交具有交叉电压和与在电位上不重叠而是相互有间隔的两个互补的差分输出信号；把两个互补的差分输出信号进行电平移位并且把每个互补差分输出信号内的模拟信号相加以形成一个与轨到轨不同的互补的输出信号；以及放大该一个互补输出信号以形成一个轨到轨互补差分信号，该信号具有类似于电平移位信号的时间特性和在第一与第二电压之间的近似地从轨到轨的转换。
20.按照权利要求19的方法，包括把CMV归一化为在第二电压电平与第一电压电平之间约一半的电位。
21.按照权利要求19的方法，其中为了改变输入信号CMV，对用于输入信号的交叉电压进行改变。
22.按照权利要求19的方法，其中为了改变输入信号的差分幅度，还对两个互补差分输出信号的差分幅度进行改变。
23.按照权利要求19的方法，还包括提供用于接收差分输入信号的第一级，其中这个第一级的差分增益小于1。
24.按照权利要求19的方法，其中第一级的差分增益约为用于差分输入信号的差分输入电压的一半。
25.一种用于存储指令数据的贮存媒体，指令数据包括第一指令数据，用于提供作为第一轨的第一电压和作为第二个另外的轨的第二个另外的电压；第二指令数据，用于接收具有共模电压(CMV)且不同于从第二电压到第一电压的轨到轨的差分输入信号；第三指令数据，用于把差分输入信号进行相位分离以形成两个互补的差分输出信号，它们具有交叉电压并且在电位上不重叠而是互相隔开的；第四指令数据，用于把两个互补的差分输出信号进行电平移动以及把每个互补差分输出信号内的模拟信号相加以形成一个与轨到轨不同的互补的输出信号；以及第五指令数据，用于放大该一个互补输出信号，以形成轨到轨互补差分信号，它具有类似于电平移位信号的时间特性和在第一与第二电压之间的近似地从轨到轨的转换。
全文摘要
公开了一种新颖的高速差分接收机(100)，它提供接收和放大具有轨到轨共模电压的小的差分电压。接收机输出信号是具有低歪斜和高对称性的差分信号。高速差分接收机(100)是基于共模电压归一化的，该共模电压归一化是在最终得到的信号被重新组合、归一化、和放大之前，根据差分相位分离方法进行的。本方法包括使用差分信号分离级(110)，其后接着是共模电压归一化级(130)，然后是受控制的增益的跨阻抗放大级(150)，以及最后使用在性质上是对称和平衡的一个或两个轨到轨放大级(170)的放大。
文档编号H03F3/30GK1943107SQ200580011854
公开日2007年4月4日 申请日期2005年4月19日 优先权日2004年4月20日
发明者E·G·克豪里, D·塞斯安斯 申请人:皇家飞利浦电子股份有限公司