集成电路封装体及其制造方法与所使用的封装基板的利记博彩app
【专利摘要】本发明是关于集成电路封装体及其制造方法与所使用的封装基板。根据一实施例的射频集成电路封装体包括：上表面与下表面分别设有若干焊垫与外部引脚的封装基板；承载于封装基板上表面的集成电路晶片，其经配置以与焊垫中的相应第一者电连接；滤波器晶片，包括：设有叉指换能器的第一表面、与第一表面相对的第二表面，及设于第一表面的金属结构。金属结构与焊垫中的相应第二者连接且与滤波器晶片的第一表面、封装基板的上表面共同形成容纳叉指换能器的第一空腔；绝缘壳体，至少遮蔽封装基板的上表面、集成电路晶片及滤波器晶片；及承载于封装基板的上表面以隔离绝缘壳体与第一空腔的隔离保护结构。本发明可以低成本实现高度可靠的产品质量。
【专利说明】
集成电路封装体及其制造方法与所使用的封装基板
技术领域
[0001]本发明涉及半导体封装领域，特别是涉及集成电路封装体、制造集成电路封装体的方法及所使用的封装基板。
【背景技术】
[0002]为迎合电子产品日益轻薄短小的发展趋势，滤波器与射频发射组件/接收组件需要被高度集成在有限面积的封装结构中，形成系统级封装(System In Package，SIP)结构，以减小硬件系统的尺寸。目前系统级封装结构的滤波器主要采用两种方式:芯片级封装(Chip Sized Package，CSP)滤波器和晶片级封装(Die Sized Package，DSP)滤波器。无论哪一种结构，其内部均需形成保护容纳滤波器的叉指换能器(Inter-Digital Transducer,IDT)的空腔。对CSP滤波器而言，其空腔支撑力较小。因而在以注塑材料，如黑色环氧树脂塑封模块产品时，CSP滤波器的本体结构极易因无法承受注塑过程中的模流压力而垮塌，使得IDT空腔受到外力破坏而造成滤波器功能失效。另一方面，对于DSP滤波器而言，其虽然具有更好的强度可以保护IDT空腔的完整，但其制作程序十分复杂，且成本比CSP滤波器高出数倍，无法在系统级封装结构与射频前端模块(Rad1 Frequency Front End Module ,RFFEM)中大量普及。
[0003]因此，对于系统级封装结构中的滤波器与射频前端模块封装整合技术，业内仍存在相当多的技术问题亟需解决。
【发明内容】
[0004]本发明的目的之一在于提供集成电路封装体，制造集成电路封装体的方法以及所使用的封装基板，其可以简单的制程和工艺实现低成本高质量的射频集成电路封装体。
[0005]本发明的一实施例提供一射频集成电路封装体，其包括:封装基板，其上表面设置有若干焊垫，其下表面设置有若干外部引脚;集成电路晶片，其承载于该封装基板上且经配置以与若干焊垫中的相应第一者电连接;滤波器晶片，其包括:设置有叉指换能器的第一表面、与第一表面相对的第二表面，以及设置于第一表面的金属结构，其中金属结构与若干焊垫中的相应第二者连接且与滤波器晶片的第一表面、该封装基板的上表面共同形成容纳该叉指换能器的第一空腔;绝缘壳体，至少遮蔽该封装基板的上表面、集成电路晶片及滤波器晶片；以及隔离保护结构，其承载于该封装基板的上表面以隔离该绝缘壳体与第一空腔。
[0006]在本发明的另一实施例中，该隔离保护结构进一步包括承载于该封装基板的上表面的支撑部及设于支撑部顶部和该滤波器晶片上方的保护盖;该支撑部、该保护盖与该封装基板的上表面之间形成保护该滤波器晶片的第二空腔。该保护盖的材料为玻璃、硅或其它具有硬度的半导体材料。在本发明的又一实施例中，该隔离保护结构可为延伸于该滤波器晶片的第一表面与该封装基板的上表面之间的非导电膏柱。在本发明的另一实施例中，该封装基板进一步设有自封装基板的上表面凹陷的凹槽，其中与金属结构连接的若干焊垫中的相应第二者设置于凹槽中，该支撑部的材料为延伸于该保护盖的下表面与该封装基板的上表面之间的非导电膏柱。在本发明的又一实施例中，该支撑部是由与该封装基板相同的材料构成，且由粘合剂连接至封装基板的上表面。在本发明的另一实施例中，该封装基板进一步设有自封装基板的上表面凹陷的凹槽，其中与该金属结构连接的若干焊垫中的相应第二者设置于凹槽中。在本发明的又一实施例中，该射频集成电路封装体进一步包括设置于该保护盖上的另一集成电路晶片，且该另一集成电路晶片经配置以与若干焊垫中的相应第三者电连接。在本发明的一实施例中，该滤波器晶片是以倒装固晶的方式经由该金属结构固定至该封装基板的上表面的。
[0007]本发明的另一实施例提供一制造射频集成电路封装体的方法，其包括:提供封装基板，该封装基板包括:上表面，其设置有若干焊垫;及下表面，其设置有若干外部引脚。制造该射频集成电路封装体的方法进一步包括提供滤波器晶片，该滤波器晶片包括:第一表面，其设置有叉指换能器;与第一表面相对的第二表面；以及设置于第一表面的金属结构。制造该射频集成电路封装体的方法进一步包含将集成电路晶片与滤波器晶片设置于该封装基板，其中集成电路晶片经配置以与若干焊垫的相应第一者电连接，该金属结构经配置以连接至若干焊垫中的相应第二者且与滤波器晶片的第一表面、该封装基板的上表面之间形成容纳该叉指换能器的第一空腔;于该封装基板的上表面形成隔离保护结构以隔离保护第一空腔；以及注塑形成绝缘壳体，该绝缘壳体至少遮蔽该封装基板的上表面、集成电路晶片及滤波器晶片，其中在注塑过程中该隔离保护结构将注塑材料隔离于该第一空腔外。
[0008]本发明的又一实施例还提供用于本发明的射频集成电路封装体的封装基板。
[0009]本发明实施例提供的射频集成电路封装体及其制造方法不仅能够保证IDT空腔的完整，还具有成本低，防止滤波器晶片被污染的优点。而且，在本发明的一些实施例中，可在滤波器晶片上进一步堆叠另外的集成电路晶片，因而可额外凸显提升产品整合密度、减小产品尺寸的优点。
【附图说明】
[0010]图1是根据本发明一实施例的射频集成电路封装体的纵向截面示意图
[0011]图2a-2d是根据本发明一实施例制造射频集成电路封装体的流程示意图，其可制造图1所示的射频集成电路封装体
[0012]图3a_3c是根据本发明另一实施例制造射频集成电路封装体的流程示意图，其可制造图3c所示的射频集成电路封装体
[0013]图4a_4c是根据本发明又一实施例制造射频集成电路封装体的流程示意图，其可制造图4c所示的射频集成电路封装体
[0014]图5是根据本发明另一实施例的射频集成电路封装体的纵向截面示意图
【具体实施方式】
[0015]为更好的理解本发明的精神，以下结合本发明的部分优选实施例对其作进一步说明。
[0016]图1是根据本发明一实施例的射频集成电路封装体100的纵向截面示意图。如图1所示，根据本发明一实施例的射频集成电路封装体100包括:封装基板10、集成电路晶片12、滤波器晶片14、绝缘壳体16及隔离保护结构18。请注意本文所指的“集成电路晶片”是指“滤波器晶片”之外的其它普通晶片，“滤波器晶片”是指未封装的裸片，本文仅是为清楚起见而将“滤波器晶片”与“集成电路晶片”并列描述。该射频集成电路封装体100还可包括贴装元件或其他附件17，例如本实施例中，其可进一步包括通过表面贴装(Surface MountTechnology，SMT)技术设置于该封装基板10上的无源元件17。
[0017]该封装基板10的上表面102设置有若干焊垫104，该封装基板10的下表面106设置有若干外部引脚108。
[0018]本实施例中，该集成电路晶片12可以是射频发射晶片或接收晶片，可通过晶片接合(Die Bond)工艺承载于该封装基板10的上表面102，且通过打线接合(Wire Bond)工艺由引线连接至封装基板10的上表面102的若干焊垫104中的相应第一者104’以经配置而实现两者间的电连接，其中打线接合使用的引线可以是金线或铜线。
[0019]该滤波器晶片14可以是声表面波滤波器晶片，其包括设置有叉指换能器142的第一表面144、与该第一表面144相对的第二表面146，以及设置于该第一表面144上的金属结构148。该金属结构148可以是锡球或金属柱。该滤波器晶片14可通过倒装固晶(Flip-ChipDie Bond,FC Die Bond)的方式经由该金属结构148与封装基板10上若干焊垫104中的相应第二者104”连接，从而该金属结构148与该滤波器晶片14的第一表面144、该封装基板10的上表面102共同形成保护容纳该叉指换能器142的第一空腔15。
[0020]该绝缘壳体16至少遮蔽该封装基板10的上表面102、该集成电路晶片12及该滤波器晶片14。
[0021]该隔离保护结构18承载于封装基板10的上表面102以隔离绝缘壳体16与该第一空腔15。在本实施例中，该隔离保护结构18包括承载于该封装基板10的上表面102的支撑部182及设于该支撑部182顶部和该滤波器晶片14上方的保护盖184。该支撑部182、该保护盖184与该封装基板10的上表面102之间形成第二空腔25以隔离该绝缘壳体16与该第一空腔15从而防止该绝缘壳体16成型时注塑材料进入该第一空腔15。该支撑部182可由与该封装基板10相同的材料构成，且由粘合剂连接至该封装基板10的上表面102。粘合剂可采用本领域技术人员所熟知的任意类型，此处不详述。该保护盖184的材料为玻璃、硅或其它具有硬度的半导体材料，其可使用类似于传统的晶片背覆(Wafer Back Coating，WBC)工艺的方法形成。
[0022]根据本发明实施例，在将滤波器晶片14整合至系统级封装结构过程中，滤波器晶片14的叉指换能器142与封装基板10的上表面102之间形成第一空腔15，且该第一空腔15得到隔离保护结构18的隔离保护。因而在后续注塑形成绝缘壳体16时，第一空腔15得以保持完整、无污。相应的，本发明无需采购昂贵的DSP封装级滤波器，且具有制造工艺简单，制造成本低的优点。
[0023]此外，本发明实施例还提供了用于制造射频集成电路封装体100的方法。
[0024]图2a_2d是根据本发明一实施例制造射频集成电路封装体100的流程示意图，其可制造图1所示的射频集成电路封装体100。
[0025]如图2a所示，提供一封装基板10，该封装基板10的上表面102设置有若干焊垫104，该封装基板10的下表面106设置有若干外部引脚108。在本实施例中，该封装基板10可进一步包括预设的隔离保护结构18的支撑部182，该支撑部182可由与该封装基板10相同的材料构成，且由粘合剂连接至该封装基板10的上表面102。在其他实施例中，该支撑部182也可非预设，而可在后续步骤，即形成隔离保护结构18的步骤中形成。
[0026]如图2b所示，提供滤波器晶片14，其包括:设置有叉指换能器142的第一表面144;与该第一表面144相对的第二表面146，以及设置于该第一表面144上的金属结构148。该金属结构148可以是预先焊接至该第一表面144的锡球或金属柱。
[0027]接着将集成电路晶片12与滤波器晶片14设置于该封装基板10，其中该集成电路晶片12可以是射频发射晶片或接收晶片，可以传统的方式通过晶片接合工艺连接至该封装基板10的上表面102，且可通过打线接合工艺由引线连接至封装基板10的上表面102的若干焊垫104中的相应第一者104’以实现两者间的电连接。而在设置滤波器晶片14时，可通过倒装固晶的方式将该金属结构148焊接至若干焊垫104中的相应第二者104”且与该滤波器晶片14的第一表面144、该封装基板10的上表面102之间形成容纳该叉指换能器142的第一空腔
15。贴装元件或其他附件17可通过表面贴装技术连接至封装基板10的上表面102。
[0028]如图2c所示，在本实施例中，于预先形成在该封装基板10上的支撑部182顶部和滤波器晶片14上方设置保护盖184以形成完整的隔离保护结构18，从而在该支撑部182、该保护盖184与该封装基板10的上表面102之间形成保护隔离第一空腔15的第二空腔25。该保护盖184的材料为玻璃、硅或其它具有硬度的半导体材料以足以抵抗注塑过程中的模流压力而不断裂，其可使用类似于传统WBC工艺的方法形成。在其他没有预先形成支撑部182的实施例中，还需先形成该隔离保护结构18的支撑部182。即在该封装基板10的上表面102设置支撑部182，其中该支撑部182具有与该封装基板10相同的材料，且使用粘合剂将支撑部182连接至该封装基板10的上表面102。此外，如本领域技术人员所理解的，在其它实施例中，可在将滤波器晶片14设置于封装基板10上之后，形成完整的隔离保护结构18;而后再设置集成电路晶片12，上述器件的安装并不拘泥于一定的顺序。
[0029]如图2d所示，接着以常规的注塑方式形成绝缘壳体16以至少遮蔽该封装基板10的上表面102、该集成电路晶片12及该滤波器晶片14，其中在注塑过程中该隔离保护结构18构建的第二空腔25可有效的将注塑材料隔离于该第一空腔15外。因而，容纳于第一空腔15内的叉指换能器142可被确保不受外力冲击且不受污染。
[0030]在其它实施例中，隔离保护结构18还具有其它的实施例方式，容后叙。
[0031]图3a_3c是根据本发明另一实施例制造射频集成电路封装体100的流程示意图。根据本实施例得到的射频集成电路封装体100同样包括:封装基板10、集成电路晶片12、滤波器晶片14、绝缘壳体16及隔离保护结构18。略不同的是，在本实施例中，该隔离保护结构18是延伸于滤波器晶片14的第一表面144与该封装基板10的上表面102之间的非导电膏柱。
[0032]具体的，如图3a所示，提供一封装基板10，该封装基板10的上表面102设置有若干焊垫104，该封装基板10的下表面106设置有若干外部引脚108。可以常规的方式将滤波器晶片14设置于封装基板10上，同样该滤波器晶片14包含设置于其第一表面144上的金属结构148。金属结构148与该滤波器晶片14的第一表面144、该封装基板10的上表面102之间形成容纳该叉指换能器142的第一空腔15。
[0033]如图3b所示，通过点胶工艺于该滤波器晶片14的第一表面144与该封装基板10的上表面102之间形成非导电膏柱，即形成隔离保护结构18。非导电膏不仅具有较低的成本，还不会污染晶片。接着可依常规的方式，如晶片接合、引线接合等将集成电路晶片12设置于封装基板10上。当然在其它实施例中，可在形成隔离保护结构18之前甚至安装滤波器晶片14之前安装集成电路晶片12。
[0034]最后，如图3c所示，注塑形成遮蔽上述器件的绝缘壳体16从而得到完整的射频集成电路封装体100。
[0035]图4a_4c是根据本发明又一实施例制造射频集成电路封装体100的流程示意图。根据本实施例得到的射频集成电路封装体100同样包括:封装基板10、集成电路晶片12、滤波器晶片14、绝缘壳体16及隔离保护结构18。与图2a-2d及图3a-3c中实施例略不同的是，在本实施例中，该封装基板1进一步设有自该封装基板10的上表面102凹陷的凹槽11，该滤波器晶片14至少部分设置于凹槽11中。该隔离保护结构18包括承载于该封装基板10的上表面102的支撑部182及设于该支撑部182顶部和该滤波器晶片14上方的保护盖184。其中，该支撑部182为延伸于保护盖184的下表面与该封装基板10的上表面102之间的非导电膏柱，其可使用点胶工艺形成。在其它实施例中，该支撑部182可由与该封装基板10相同的材料构成，且由粘合剂连接至该封装基板1的上表面102。。
[0036]具体的，如图4a所示，提供一封装基板10，该封装基板10的上表面102设置有若干焊垫104，该封装基板10的下表面106设置有若干外部引脚108，且该封装基板10进一步设有自该封装基板10的上表面102凹陷的凹槽11，其中经配置以与该金属结构148连接的若干焊垫104中的相应第二者104”设置于凹槽11中。可以常规的方式将滤波器晶片14设置于封装基板10上的凹槽11内，同样该滤波器晶片14包含设置于其第一表面144上的金属结构148。金属结构148与该滤波器晶片14的第一表面144、该封装基板10的上表面102(凹陷于凹槽11的底部的部分)之间形成容纳该叉指换能器142的第一空腔15。
[0037]如图4b所示，通过点胶工艺于该封装基板10的上表面102形成非导电膏柱，即形成支撑部182。非导电膏不仅具有较低的成本，还不会污染晶片。接着可使用类似于传统的晶片背覆工艺的方法于支撑部182顶部和滤波器晶片14上方设置保护盖184。该保护盖184的材料为玻璃、硅或其它具有硬度的半导体材料。可依常规的方式，如晶片接合、引线接合等将集成电路晶片12设置于封装基板10上。当然在其它实施例中，可在形成隔离保护结构18之前甚至安装滤波器晶片14之前安装集成电路晶片12。
[0038]最后，如图4c所示，注塑形成遮蔽上述器件的绝缘壳体16从而得到完整的射频集成电路封装体100。
[0039]在封装基板10上设置容纳滤波器晶片14的凹槽11可降低射频集成电路封装体100的封装高度，同时可在需要的情况下允许进一步在保护盖184上堆叠其它集成电路晶片20而不至于使封装体高度过高。当然在不考虑封装尺寸限制的前提下，装基板10上完全可不设置凹槽11，同样可在保护盖184上堆叠其它集成电路晶片20。
[0040]图5是根据本发明又一实施例射频集成电路封装体100的纵向截面示意图，其演示在保护盖184上堆叠其它集成电路晶片20。
[0041 ]如图5所示，本实施例的射频集成电路封装体100具有类似于图4a_4c所示实施例的结构。类似的，射频集成电路封装体100包括:封装基板10、集成电路晶片12、滤波器晶片
14、绝缘壳体16及隔离保护结构18。射频集成电路封装体100进一步包括可通过传统的晶片结合工艺设置于该保护盖184上的另一集成电路晶片20，且该另一集成电路晶片20可通过打线接合工艺由引线连接至封装基板10的上表面102的若干焊垫104中的相应第三者104”’以实现两者间的电连接，其中打线接合使用的引线可以是金线或铜线。
[0042]本发明实施例提供的射频集成电路封装体100，通过滤波器晶片14上设置的金属结构148将滤波器晶片14固定至封装基板10上，从而在将滤波器晶片14顺利整合至系统级封装结构或射频前端模块的同时，为滤波器晶片14提供了 IDT空腔。因此，本发明可无需采购昂贵的预先制作保护空腔的DSP封装级滤波器，而直接采用低价的普通的滤波器晶片14。此外，本发明实施例提供的射频集成电路封装体还具有隔离保护结构18，其不仅在后续注塑形成绝缘壳体16时保证IDT空腔的完整性，还具有成本低，防止晶片被污染的优点。另外，在本发明的一些实施例中，可在滤波器晶片14上进一步堆叠另一集成电路晶片20，可进一步提升产品整合密度，减小产品尺寸，且降低封装成本。
[0043 ]本发明的技术内容及技术特点已揭示如上，然而熟悉本领域的技术人员仍可能基于本发明的教示及揭示而作种种不背离本发明精神的替换及修饰。因此，本发明的保护范围应不限于实施例所揭示的内容，而应包括各种不背离本发明的替换及修饰，并为本专利申请权利要求书所涵盖。
【主权项】
1.一种射频集成电路封装体，其包括: 封装基板，所述封装基板的上表面设置有若干焊垫，所述封装基板的下表面设置有若干外部引脚； 集成电路晶片，其承载于所述封装基板上且经配置以与所述若干焊垫中的相应第一者电连接； 滤波器晶片，其包括: 第一表面，所述第一表面设置有叉指换能器； 第二表面，所述第二表面与所述第一表面相对；以及 金属结构，其设置于所述第一表面;所述金属结构与所述若干焊垫中的相应第二者连接，且与所述滤波器晶片的第一表面、所述封装基板的上表面共同形成容纳所述叉指换能器的第一空腔； 绝缘壳体，至少遮蔽所述封装基板的上表面、所述集成电路晶片及所述滤波器晶片；以及 隔离保护结构，其承载于所述封装基板的上表面以隔离所述绝缘壳体与所述第一空腔。2.根据权利要求1所述的射频集成电路封装体，其中所述隔离保护结构进一步包括承载于所述封装基板的上表面的支撑部及设于所述支撑部顶部和所述滤波器晶片上方的保护盖;所述支撑部、所述保护盖与所述封装基板的上表面之间形成保护所述滤波器晶片的第二空腔。3.根据权利要求2所述的射频集成电路封装体，其中所述保护盖的材料为玻璃、硅或其它具有硬度的半导体材料。4.根据权利要求1所述的射频集成电路封装体，其中所述隔离保护结构为延伸于所述滤波器晶片的第一表面与所述封装基板的上表面之间的非导电膏柱。5.根据权利要求2所述的射频集成电路封装体，其中所述封装基板进一步设有自所述封装基板的上表面凹陷的凹槽，其中与所述金属结构连接的所述若干焊垫中的相应第二者设置于所述凹槽中，所述支撑部的材料为延伸于所述保护盖的下表面与所述封装基板的上表面之间的非导电膏柱。6.根据权利要求2所述的射频集成电路封装体，其中所述支撑部是由与所述封装基板相同的材料构成，且由粘合剂连接至所述封装基板的上表面。7.根据权利要求6所述的射频集成电路封装体，其中所述封装基板进一步设有自所述封装基板的上表面凹陷的凹槽，其中与所述金属结构连接的所述若干焊垫中的相应第二者设置于所述凹槽中。8.根据权利要求2所述的射频集成电路封装体，其进一步包括设置于所述保护盖上的另一集成电路晶片，且所述另一集成电路晶片经配置以与所述若干焊垫中的相应第三者电连接。9.根据权利要求1所述的射频集成电路封装体，其中所述滤波器晶片是以倒装固晶的方式经由所述金属结构固定至所述封装基板的上表面的。10.一种制造射频集成电路封装体的方法，其包括: 提供封装基板，所述封装基板包括: 上表面，所述上表面设置有若干焊垫； 下表面，所述下表面设置有若干外部引脚； 提供滤波器晶片，所述滤波器晶片包括: 第一表面，所述第一表面设置有叉指换能器； 第二表面，所述第二表面与所述第一表面相对；以及 金属结构，所述金属结构设置于所述第一表面； 将集成电路晶片与所述滤波器晶片设置于所述封装基板，其中所述集成电路晶片经配置以与所述若干焊垫的相应第一者电连接，所述金属结构经配置以连接至所述若干焊垫中的相应第二者且与所述滤波器晶片的第一表面、所述封装基板的上表面之间形成容纳所述叉指换能器的第一空腔； 于所述封装基板的上表面形成隔离保护结构以隔离保护所述第一空腔； 以及 注塑形成绝缘壳体，所述绝缘壳体至少遮蔽所述封装基板的上表面、所述集成电路晶片及所述滤波器晶片，其中在所述注塑过程中所述隔离保护结构将注塑材料隔离于所述第一空腔外。11.根据权利要求10所述的方法，其中形成所述隔离保护结构进一步包含于所述封装基板的上表面设置支撑部，及于所述支撑部顶部和所述滤波器晶片上方设置保护盖，以便所述支撑部、所述保护盖与所述封装基板的上表面之间形成保护所述滤波器晶片的第二空腔。12.根据权利要求11所述的方法，其中所述保护盖的材料为玻璃或硅或其它具有硬度的半导体材料。13.根据权利要求10所述的方法，其中形成所述隔离保护结构进一步包括于所述滤波器晶片的第一表面与所述封装基板的上表面之间形成非导电膏柱。14.根据权利要求11所述的方法，其中所述封装基板进一步设有自所述封装基板的上表面凹陷的凹槽，与所述金属结构连接的所述若干焊垫中的相应第二者设置于所述凹槽中，其中设置所述支撑部进一步包含于所述封装基板的上表面形成非导电膏柱。15.根据权利要求11所述的方法，其中设置所述支撑部进一步包含使用粘合剂将具有与所述封装基板相同的材料的隔离保护结构连接至所述封装基板的上表面。16.根据权利要求15所述的方法，其中所述封装基板进一步设有自所述封装基板的上表面凹陷的凹槽，其中与所述金属结构连接的所述若干焊垫中的相应第二者设置于所述凹槽中。17.根据权利要求11所述的方法，其进一步包括将另一集成电路晶片设置于所述保护盖上，所述另一集成电路晶片经配置以与所述若干焊垫中的相应第三者电连接。18.根据权利要求10所述的方法，其进一步包括将所述滤波器晶片以倒装固晶的方式经由所述金属结构固定至所述封装基板的上表面。19.一种封装基板，其包括: 上表面，所述上表面设置有若干焊垫； 下表面，所述下表面设置有若干外部引脚；以及 隔离保护结构，其是由与所述封装基板相同的材料构成，且经由粘合剂连接至所述封装基板的上表面。20.根据权利要求17所述的封装基板，其中所述封装基板进一步设有自所述封装基板的上表面凹陷的凹槽，且其中所述若干焊垫中的相应者设置于所述凹槽中。21.—种封装基板，其包括: 上表面，所述上表面设置有若干焊垫； 下表面，所述下表面设置有若干外部引脚；以及 凹槽，所述凹槽自所述封装基板的上表面凹陷，且其中所述若干焊垫中的相应者设置于所述凹槽中。
【文档编号】H01L23/498GK106067457SQ201610653888
【公开日】2016年11月2日
【申请日】2016年8月11日
【发明人】汪虞, 李维钧, 郭桂冠
【申请人】苏州日月新半导体有限公司