一种具有自适应偏置场板的高压mos器件的利记博彩app
【专利摘要】本发明属于半导体【技术领域】，具体涉及到一种具有自适应偏置场板的高压MOS器件。本发明主的技术方案，与传统与固定电位连接的金属场板(如栅场板、漏场板以及源场板)相比，一方面，自偏置场板能削弱常规金属场板末端的电场尖峰，进一步优化器件表面电场的分布；更重要的是，自偏置场板的偏置电位可根据需要设定；因而，其提高器件耐压的效果更明显。另一方面，自偏置场板能增强对漂移区的辅助耗尽作用，高漂移区掺杂浓度以降低器件比导通电阻。该自偏置场板能应用于多种功率器件中。本发明尤其适用于高压MOS器件。
【专利说明】一种具有自适应偏置场板的高压MOS器件
【技术领域】
[0001]本发明属于半导体【技术领域】，具体涉及到一种具有自适应偏置场板的高压MOS器件。
【背景技术】
[0002]功率半导体器件的关键是实现高击穿电压和低导通电阻。对于常规LDMOS器件而言，漂移区长度随器件击穿电压的升高而单调增加，同时漂移区浓度降低；这不仅会增大器件(或电路)的芯片面积和成本，而且不利于芯片小型化。更严重的是，器件的导通电阻随漂移区长度(或器件耐压)的增加而增大，其中击穿电压(BV, Breakdown Voltage)与比导通电阻(Rm，sp，Specific on-Resistance)之间关系可表不为Rm，sp 00 BV2_5,而导通电阻的增加导致器件功耗急剧增加，并且器件开关速度也随之减低。
[0003]为提高器件的击穿电压，研究者提出了诸多方法，其中结终端技术应用广泛。文献(陈星弼，【p-η+结有场板时表面电场分布的简单表不式】电子学报，Vol.14, 36 (1986))中指出金属场板(如图1所示)可有效降低器件主结的曲率和表面电场峰值并改善器件表面电场的分布，从而提高器件击穿电压；但金属场板技术不足之处在于金属场板的末端会引入一个新的电场尖峰而影响器件的击穿特性。
[0004]进一步，有研究者提出了如图2所示的斜坡金属场板技术，可以降低金属场板末端附加电场尖峰值从而提高器件击穿特性；但该技术因非均匀氧化层工艺实现难度大而应用受限。
[0005]为了达到与非均匀场板技术相似的效果并降低工艺难度，有研究者提出了如图3所示的阶梯场板技术(张波，【提高器件耐压的非均匀氧化层场板技术】，半导体技术，N0.4，19(1998))，该场板技术同样能缓解金属场板末端的附加电场尖峰而提高器件击穿电压，并且工艺相对简单；但阶梯场板工艺的实现需要增加掩模版的张数，因此成本会有所增加。
[0006]除了金属场板技术夕卜，也有研究者提出了 SIPOS (Sem1-1nsulatingPoly-crystal I ine Silicon)阻性场板技术(L.E.Clark and D.S.Zoroglu, [Enhancementof breakdown properties of overlay annular d1des by field shaping resistivefilms], Solid-State Electronics, vol.15，pp.653-657，1972)，如图 4 所示。此 SIPOS 阻性场板是在器件的场介质(如场氧化物)上引入了多晶电阻层，多晶电阻层的两端分别与器件的阳极和阴极相连。由于SIPOS电阻上有均匀电流流过，所以SIPOS上从阳极到阴极之间压降均匀，其耦合作用使器件漂移区电场分布均匀，有效降低了器件表面电场峰值，避免了器件表面提前击穿从而提高器件击穿电压；然而SIPOS中由漏极流向源极的泄露电流较大，会增加器件的功耗。
[0007]为提高场板作用，有研究者提出了如图5多指栅场板(Dawei Xu, Xinhong Chengand Yuehui Yu,et.al,【Improved LDMOS performance with buried mult1-fingergates] , Microelectronic Engineering, vol.122 (2014)，pp.29-32)与如图 6 所不的浮空金属环结构(Jinping Zhang, Yi Ye and Chunhua Zhou, et.al,【High breakdown voltage4H-SiC MESFETs with floating metal strips】，Microelectronic Engineering, vol.85(2008), pp.89-92)结构，优化表面电场分布以提高器件击穿电压。
[0008]以上场板技术中场板的电位总是与源电极或栅电极相连，场板接一个固定电位，或处于浮空状态，其电位都不能自适应的跟随器件耐压的变化，使得场板对器件表面电场的优化作用受限。
[0009]RESURF技术是功率半导体器件中缓解器件击穿电压与导通电阻矛盾的常用技术，图7、图8与图9分别给出了 single-、double-和triple-RESURF技术截面示意图。该技术能降低器件表面电场峰值而避免提前击穿，同时也能提高漂移区的掺杂浓度而降低导通电阻。文献(Y.Koishikawa, M.Takahashi, H.Yangigawa, and T.Kunyama,【Double RESURFdevice technology for power ICs】，NEC RES Dev., 1994, 359(4) ；Mohamed Imam, ZiaHossain, Mohammed Quddus, Jim Adams, Charles Hoggatt, Takeshi Ishiguro, andRajesh Nair, 【Design and Optimizat1n of Double-RESURF High-VoltageLateralDevices for a Manufacturable Process], IEEE TRANSACT1NS ON ELECTRONDEVICES, VOL.50, N0.7，JULY2003)中给出了 RESURF技术对提高器件击穿电压与降低导通电阻的效果，从中可以看出RESURF技术有效缓解了器件击穿电压与比导通电阻间2.5次方的矛盾关系。但是RESURF技术中的P型层需要占用N型漂移区中的部分电流通道而不利于进一步降低导通电阻。
【发明内容】
[0010]本发明的目的，就是针对上述问题，提出一种具有自适应偏置场板的高压MOS器件。
[0011]本发明的技术方案:一种具有自适应偏置场板的高压MOS器件,包括第一导电类型半导体衬底1、位于第一导电类型半导体衬底I上层的第二导电类型半导体漂移区2和第一导电类型半导体体区3、位于第二导电类型半导体漂移区2和第一导电类型半导体体区3上层的场介质层7 ;所述第一导电类型半导体体区3上层设置有相互独立的第一导电类型半导体体接触区5和第二导电类型半导体源区4 ;第一导电类型半导体体接触区5和第二导电类型半导体源区4上表面设置有源电极8 ;第二导电类型半导体漂移区2上层远离第一导电类型半导体体区3的一端设置有第二导电类型半导体漏区6 ;第二导电类型半导体漏区6上表面设置有漏电极10 ;所述源电极8和漏电极10之间设置有栅电极9 ;所述栅电极9与第一导电类型半导体体区3和第二导电类型半导体源区4接触；其特征在于，还包括自适应偏置场板，所述自适应偏置场板由场板11和薄膜电阻13构成；其中，所述场板11与薄膜电阻13电气连接；所述场板11设置在场介质层7的上表面；所述薄膜电阻13的一端与源电极8电气连接，其另一端与漏电极10电气连接。
[0012]本发明总的技术方案，与传统与固定电位连接的金属场板(如栅场板、漏场板以及源场板)相比，一方面，自偏置场板能削弱常规金属场板末端的电场尖峰，进一步优化器件表面电场的分布；更重要的是，自偏置场板的偏置电位可根据需要设定；因而，其提高器件耐压的效果更明显。另一方面，自偏置场板能增强对漂移区的辅助耗尽作用，高漂移区掺杂浓度以降低器件比导通电阻；而且，该器件与常规CMOS工艺流程能良好兼容。该自偏置场板能应用于多种功率器件中。
[0013]具体的，所述场板11与薄膜电阻13之间设置有钝化层12 ;所述场板11与薄膜电阻13之间为通过导电材料(144)建立电气连接；所述薄膜电阻13的一端与源电极8为通过导电材料(141)建立电气连接，其另一端与漏电极10为通过导电材料(143)建立电气连接。
[0014]具体的，所述场板(11)由m个相互独立的子场板构成，每个子场板通过导电材料(145)与薄膜电阻(13)建立电气连接；其中，m为正整数。
[0015]具体的，所述m个子场板中有η个子场板与源电极8连接,有k个子场板与漏电极10连接，有j个子场板与栅电极9连接，有h个子场板处于浮空状态；其中n、k、j、h均为自然数且 n+k+j+h <m, n^0,k^0,j ^ O, h ^ O0
[0016]具体的，所述第二导电类型半导体漂移区2为超结结构。
[0017]在衬底与有源层之间还可引入埋层介质20，形成具有自偏置场板的高压SOILDMOS形成SOI结构；所述SOI结构的衬底层I是第一导电类型或第二导电类型半导体；所述埋层介质20是二氧化硅或是介电系数比二氧化硅介电系数小的低K介质；功率MOS器件的漂移区可增加第一导电类型半导体层18，或所述漂移区的表面形成第一导电类型半导体层17 ;钝化层12上形成的薄膜电阻13的形成材料是多晶硅，或是镍铬合金、氮化钽、氧化锡等；所述场介质层7、绝缘介质91是二氧化硅或是介电系数比二氧化硅介电系数大的高K等材料；具有自偏置场板的高压功率MOS器件的版图为叉指状分布、环状或对称多边形分布；功率器件区中第二导电类型的漂移区采用均匀掺杂，或采用横向变掺杂技术
[0018]本发明的有益效果为，通过自偏置场板对功率器件表面的场板引入自适应的偏置电压，使得器件表面电场分布更加均匀而提高器件击穿电压；自偏置场板可辅助耗尽漂移区而提高掺杂水平，降低器件导通电阻；自偏置场板不引入附加寄生电容，不影响器件开关与频率特性；该器件与常规CMOS工艺流程能良好兼容。
【专利附图】
【附图说明】
[0019]图1是常规金属场板的结构示意图；
[0020]图2是斜坡氧化层金属场板的结构示意图；
[0021]图3是阶梯氧化层金属场板的结构示意图；
[0022]图4是常规SIPOS阻性场板的结构示意图；
[0023]图5是具有多个栅场板的LDMOS器件结构示意图；
[0024]图6具有浮空金属环的LDMOS器件结构示意图；
[0025]图7为常规single-RESURF结构的截面示意图；
[0026]图8为常规doubIe-RESURF结构的截面示意图；
[0027]图9为常规triple-RESURF结构的截面示意图；
[0028]图10是本发明提出的具有自偏置场板的高压LDMOS器件条状版图分布俯视图；
[0029]图11是本发明提出的具有自偏置场板的高压LDMOS器件圆环状版图分布俯视图；
[0030]图12是图10和图11中沿虚线M1M2的剖面示意图；
[0031]图13是图10和图11中沿虚线N1N2的剖面示意图；
[0032]图14是本发明提出的具有多个自偏置场板的高压LDMOS器件条状版图分布示意图；
[0033]图15是本发明提出的具有多个自偏置场板的高压LDMOS器件圆环状版图分布示意图；
[0034]图16是图14和图15中沿虚线M1M2的剖面示意图；
[0035]图17是图14和图15中沿虚线N1N2的剖面示意图；
[0036]图18是本发明提出的具有自偏置场板的高压LDMOS器件在场介质层的条状版图分布示意图；
[0037]图19是本发明提出的具有自偏置场板和源场板的高压LDMOS器件在钝化层的条状版图分布示意图；
[0038]图20是图19中沿虚线M1M2的剖面示意图；
[0039]图21是图19中沿虚线L1L2的剖面示意图；
[0040]图22是本发明提出的具有自偏置场板和漏场板的高压LDMOS器件在钝化层的条状版图分布示意图；
[0041]图23是图22中沿虚线M1M2的剖面示意图；
[0042]图24是图22中沿虚线L1L2的剖面示意图；
[0043]图25是本发明提出的具有自偏置场板和栅场板的高压LDMOS器件在钝化层的条状版图分布示意图；
[0044]图26是图25中沿虚线M1M2的剖面示意图；
[0045]图27是图25中沿虚线N1N2的剖面示意图；
[0046]图28是本发明提出的具有自偏置场板和浮空金属环的高压LDMOS器件在钝化层的条状版图分布示意图；
[0047]图29是图28中沿虚线M1M2的剖面示意图；
[0048]图30是图28中沿虚线N1N2的剖面示意图；
[0049]图31是本发明提出的double-RESURF的具有自偏置场板的高压LDMOS器件结构剖面示意图；
[0050]图32是本发明提出的triple-RESURF形式的具有自偏置场板的高压LDMOS器件结构剖面示意图；
[0051]图33是本发明提出的具有自偏置场板的平面栅型高压S0ILDM0S器件结构剖面示意图；
[0052]图34是本发明提出的具有自偏置场板的槽栅型高压S0ILDM0S器件结构剖面示意图；
[0053]图35是本发明提出的具有自偏置场板的高压超结型LDMOS器件结构示意图；
[0054]图36是本发明提出的具有自偏置场板的高压LDMOS器件在场介质层的圆环状版图分布示意图；
[0055]图37是本发明提出的具有自偏置场板的高压LDMOS器件在钝化层的圆环状版图分布示意图；
【具体实施方式】
[0056]下面结合附图和以N沟道具有自偏置场板的高压LDMOS实施例对本发明进行详细的描述
[0057]实施例1:
[0058]如图10所示，本例为具有自偏置场板的高压LDMOS器件条状结构版图分布示意图，图12是图10中沿虚线M1M2的剖面示意图，图13是图10中沿虚线N1N2的剖面示意图，包括至上而下的衬底层1、有源层2以及场介质层7。高压LDMOS器件还包括P型体区3、源区4、体接触区5、漏区6、绝缘介质91、导电材料92和场板11，其中体区3与漏区6之间的有源层2称为漂移区，绝缘介质91与导电材料92构成绝缘栅。源区4和体接触区5的共同引出端为源电极8，漏区6的引出端为漏电极10。场板11位于场介质层7的上表面。
[0059]薄膜电阻13位于场介质层7上表面，薄膜电阻13的两端分别和源电极8与漏电极10电气接触，场板11和薄膜电阻13接触，从而形成自偏置场板。
[0060]本例的工作原理为:
[0061]基于电阻分压理论，因为场板11与薄膜电阻13接触，场板11上的偏置电压采自于薄膜电阻13。通过改变场板11与薄膜电阻13的接触位置，可实现对场板11的偏置电压调制；同时，场板11上的偏置电压能自适应跟随MOS器件漏极所加的电压和MOS器件耐压的变化而变化，实现对器件表面电场的最优调制效果，提高器件击穿电压。同时，该自偏置场板能辅助耗尽漂移区，提高漂移区掺杂浓度而降低器件比导通电阻
[0062]场介质7可是二氧化硅或是介电系数比二氧化硅更高的介质材料；当场介质7是高介电系数材料时可增强自偏置场板对漂移区的辅助耗尽作用，有利降低器件导通电阻。
[0063]本例也适用于环状结构，其版图如图11所示，其原理与条状结构相同，在此不再赘述。
[0064]图14与图15是本发明提出的具有多个自偏置场板的高压LDMOS器件条状和环状版图结构示意图，图16是图14与图15中沿虚线M1M2的剖面示意图，图17是图14和图15中沿虚线N1N2的剖面示意图。与图10和图11所示结构相比，图14与图15所示结构具有多个(η>1)自偏置场板。多个自偏置场板能更好的优化器件表面电场分布，有利提高器件击穿电压。
[0065]图36与图37是本发明提出的具有自偏置场板的高压LDMOS版图与剖面示意图。与图11、图12的差别是，此时薄膜电阻13位于钝化层12上表面。薄膜电阻13的两端分别通过导电材料142和143与MOS器件的源电极8和漏电极10接触，场板11通过导电材料144和薄膜电阻13接触，从而形成自偏置场板，通过改变导电材料144与薄膜电阻13的接触位置，可实现对场板11的偏置电压调制。
[0066]本发明中用于实现场板上自适应偏置电压的薄膜电阻13位于器件场介质层7或钝化层12上，有效降低了器件寄生电容，几乎不影响器件的开关特性与频率特性。
[0067]图19-图21、图22-图24、图25-图27、图28-图30分别是本发明提出的具有自偏置场板和源场板、具有自偏置场板和栅场板、具有自偏置场板构和漏场板、具有自偏置场板和浮空金属环的高压LDMOS器件俯视图和剖面图；其中图19-图21中场板111与源电极电位相连，图22-图24中场板113与漏电极电位相连，图25-图27中场板111与栅电极电位相连，图28-图30中场板112处于浮空状态。自偏置场板与常规源场板、栅场板、漏场板或浮空金属环等终端技术组合运用，提高了器件设计的灵活性，有效优化器件表面电场分布以提高器件击穿电压。这些组合应用不会增加器件工艺实现难度。
[0068]上述结构中的自适应偏置场板工作原理与实施例1相同。
[0069]实施例2:
[0070]如图31所示，本例为double-RESURF型具有自偏置场板的高压LDMOS器件剖面示意图。相比图16所示结构，本例是在漂移区表面与体内引入P型埋层形成double-RESURF作用机制。通过优化自偏置场板11或111、112、113与P型埋层的位置，RESURF与自偏置场板共同调制器件表面电场分布并提高漂移区掺杂浓度，从而提高器件击穿电压并降低器件比导通电阻。
[0071 ] 本例的自适应偏置场板工作原理与实施例1相同。
[0072]同理也可适用于triple-RESURF型结构，如图32所示，为triple-RESURF形式的具有自偏置场板的高压LDMOS器件结构剖面示意图，其原理与实施例2相同，在此不再赘述。
[0073]实施例3:
[0074]图33所示，为本例的平面栅型具有自偏置场板的高压SOI LDMOS器件结构剖面示意图。其中衬底层I为P型。该类器件也具有SOI器件具有的诸多优点。
[0075]本例的自适应偏置场板工作原理与实施例1相同。
[0076]同理也适用于槽栅型结构，如图34所示，为具有自偏置场板的槽栅型高压S0ILDM0S器件结构剖面示意图，其原理与实施例3相同。
[0077]实施例4:
[0078]本发明提出的自偏置场板也适用于超结器件。
[0079]如图25所示，本例为具有自偏置场板的超结型LDMOS器件结构示意图(图中场板111、112、113上的偏置电位连接方式可以与源电极、漏电极或栅电极相连，或处于浮空状态，此图中并未标注出)。自偏置场板能调制器件表面电场的分布以提高器件击穿电压，而超结器件具有较低的比导通电阻，二者结合能有效提升器件整体性能。
[0080]本例的自适应偏置场板工作原理与实施例1相同。
[0081]本发明提出的具有自偏置场板的高压功率MOS器件，其版图还可以是如图14、图18、图19、图22、图25、图28所示的叉指状分布，或者如图15与图37所示的圆环对称分布；其中图14与图15描述了具有自偏置场板的高压功率MOS器件在场介质层7上形成场板11与薄膜电阻13，图19、图22、图25、图28与图37描述了具有自偏置场板的高压功率MOS器件在钝化层12上形成薄膜电阻13。
[0082]本发明提出的具有自偏置场板的高压功率MOS器件，其版图也可是对称多边形分布，如正六边形与正八边形分布等。
[0083]以上实施案例中自偏置场板也适用于IGBT、晶闸管与二极管等功率器件。
【权利要求】
1.一种具有自适应偏置场板的高压MOS器件，包括第一导电类型半导体衬底(I)、位于第一导电类型半导体衬底(I)上层的第二导电类型半导体漂移区(2)和第一导电类型半导体体区(3)、位于第二导电类型半导体漂移区(2)和第一导电类型半导体体区(3)上层的场介质层(7);所述第一导电类型半导体体区(3)上层设置有相互独立的第一导电类型半导体体接触区(5)和第二导电类型半导体源区(4);第一导电类型半导体体接触区(5)和第二导电类型半导体源区(4)上表面设置有源电极(8);第二导电类型半导体漂移区(2)上层远离第一导电类型半导体体区(3)的一端设置有第二导电类型半导体漏区￠);第二导电类型半导体漏区(6)上表面设置有漏电极(10);所述源电极(8)和漏电极(10)之间设置有栅电极(9);所述栅电极(9)与第一导电类型半导体体区(3)和第二导电类型半导体源区(4)接触；其特征在于，还包括自适应偏置场板，所述自适应偏置场板由场板(11)和薄膜电阻(13)构成；其中，所述场板(11)与薄膜电阻(13)电气连接；所述场板(11)设置在场介质层(7)的上表面；所述薄膜电阻(13)的一端与源电极(8)电气连接，其另一端与漏电极(10)电气连接。
2.根据权利要求1所述的一种具有自适应偏置场板的高压MOS器件，其特征在于，所述场板(11)与薄膜电阻(13)之间设置有钝化层(12);所述场板(11)与薄膜电阻(13)之间为通过导电材料(145)建立电气连接；所述薄膜电阻(13)的一端与源电极⑶为通过导电材料(141)建立电气连接，其另一端与漏电极(10)为通过导电材料(143)建立电气连接。
3.根据权利要求2所述的一种具有自适应偏置场板的高压MOS器件，其特征在于，所述场板(11)由m个相互独立的子场板构成，每个子场板通过导电材料(145)与薄膜电阻(13)建立电气连接；其中，m为正整数。
4.根据权利要求3所述的一种具有自适应偏置场板的高压MOS器件，其特征在于，所述m个子场板中有η个子场板与源电极(8)连接，有k个子场板与漏电极(10)连接，有j个子场板与栅电极(9)连接，有h个子场板处于浮空状态；其中n、k、j均、h为自然数且n+k+j+h<m, n^0,k^0,j ^ O, h ^ O0
5.根据权利要求1-4任意一项所述的一种具有自适应偏置场板的高压MOS器件，其特征在于，所述第二导电类型半导体漂移区(2)为超结结构。
【文档编号】H01L29/78GK104201207SQ201410472165
【公开日】2014年12月10日 申请日期:2014年9月16日 优先权日:2014年9月16日
【发明者】罗小蓉, 魏杰, 熊佳云, 李鹏程, 杨超, 石先龙, 张波, 李肇基 申请人:电子科技大学