专利名称：金属－绝缘物－金属电容的集成电路装置及其利记博彩app
技术领域：
本发明有关一种集成电路装置及其利记博彩app，特别是有关一种包含一高品质因子的金属-绝缘物-金属电容(high Q MIM capacitor)的集成电路装置及其利记博彩app。
(2)背景技术在目前的超大型集成电路(VLSI circuit)如一动态随机存取存储器(DRAM)的结构中，电容是被应用来储存数字数据的储存元件。数字数据的写入乃是以对电容充电或放电的步骤来完成。以目前的超大型集成电路制造技术而言，绝大部份是采用双复晶硅电容(double polysilicon capacitor，DPC)来当作超大型集成电路中的电容。
现今大部份的数字与模拟电路皆是以超大型集成电路制造技术来制造，唯有在微波频率(RF)方面的应用尚未能够以超大型集成电路的技术来完成。自1990年以来，微波频率与毫米波频率的应用已经逐渐被开发，且应用在个人通信(PCS)、无线通讯区域网路(WLAN)、卫星通信、无线电电脑周边组件等消费性电子产品上。这些无线通讯的应用是采用单晶微波集成电路(monolithic microwave integratedcircuit，MMIC)的技术所开发出来的。
在MMIC的电路设计上，为了要能够使其电路中的电容具有较高的电容值，其发展的趋势是朝向采用金属-绝缘物-金属(metal-insulator-metal，MIM)电容来当作MMIC电路的电容。MIM电容是以两块金属导体板加上隔开两块金属导体板的介电材质所组成。
然而，大部份的现有电容是采用复晶硅层来形成电容的上电极板与下电极板。在高频与微波频率的应用上，由复晶硅层当作电容的电极板所组成的电容，因为复晶硅材质具有的高电阻，通常会导致其具有较差的品质因子(qualityfactor)。
因此便有其需要提供一种制造包含具高品质因子的MIM电容的集成电路装置及其利记博彩app。
(3)发明内容本发明的一目的在于提供具有一MIM薄膜电容的一集成电路装置，在其中MIM薄膜电容的介电层是由一种防反射光层(ARC)所组成。
本发明的另一目的在于提供一种包含一MIM薄膜电容的一集成电路装置的利记博彩app。
根据本发明一方面提供一种包含一MIM电容的集成电路装置，其特点是，包括一半导体装置，于其中包含数个半导体元件；一第一介电层，形成于该半导体装置上方；一第一阻障层，形成于一部份的该第一介电层上方；一电容，形成于该第一阻障层上方，它由一电容下电极板、一电容介电层与一电容上电极板所组成，在其中该电容介电层是由具有较高的介电常数的防反射光层所组成；一内金属介电层，形成于该电容与该第一介电层上方；以及一金属层，形成于该内金属介电层上方，用以埋入导线。
根据本发明另一方面提供一种制造集成电路装置的方法，其特点是，包括下列步骤在一半导体装置上方形成一第一阻障层；在该第一阻障层上方形成一第一金属层；以具有较高的介电常数的防反射光层形成一第二介电层于该第一金属层上方；形成一第二金属层于该第二介电层上方；通过移除一部份的该第二金属层与该第二介电层且露出一部份的该第一金属层而产生一电容上电极板；通过移除一部份的该第一金属层与该第一阻障层且露出一部份的该半导体装置而产生一电容下电极板；形成一内金属介电层于该电容上电极板、该电容下电极板与该半导体装置上方；于该内金属介电层内形成数个插塞以连接该电容上电极板与该电容下电极板；形成一第二阻障层于该内金属介电层上方；形成一第三金属层于该第二阻障层上方；以及移除一部份的该第三金属层与该第二阻障层且露出一部份的该内金属介电层。
本发明的集成电路装置于其中第一介电层，较佳者为以化学气相沉积法(CVD)所形成的硼磷硅玻璃(BPSG)所组成，沉积于该半导体装置上方；一第一阻障层，较佳者为以溅镀法所形成的氮化钛所组成，形成于一部份的该第一介电层上方；其中电容介电层是由具有较高的介电常数的一种防反射光层(ARC)，如氮氧化硅(SiOxNy)所组成；一内金属介电层，较佳者为以CVD法形成的硼磷硅玻璃(BPSG)或以等离子体辅助化学气相沉积法(PECVD)法形成的二氧化硅所组成，形成于该电容与该第一介电层上方；一第二阻障层，较佳者为以溅镀法所形成的氮化钛所组成，形成于一部份的该内金属介电层上方；以及一金属层，较佳者为以溅镀法所形成的铝所组成，形成于该第二阻障层上方，用以埋入导线。其中该内金属介电层内部还包含数个介层插塞，其为以具有回蚀刻的钨插塞制作步骤所形成，用以互相连接该电容上电极板、该电容下电极板与该金属层。
上述的半导体装置包含一半导体基材，可为一硅基材或一砷化镓基材，以及一场氧化层，形成于该半导体基材上方，而形成该半导体基材的一主动区域与一隔离区域。
当第一介电层，如以CVD法形成的硼磷硅玻璃层，沉积于该场氧化层与该半导体基材上方后，一平坦化工艺步骤(planaration process)，如一具有回蚀刻的旋涂式玻璃(SOG with etch back)制作步骤或一化学机械研磨法(CMP)工艺步骤便被应用，以平坦化该第一介电层。该第一阻障层具有一200-1000埃的较佳厚度，而该电容下电极板是由CVD法所沉积的钨或溅镀法所沉积的铝所组成，其具有一5000-10000埃的较佳厚度。另一方面，该电容上电极板是由溅镀法所沉积的铝所组成。
而可用来做为本发明的具有较高的介电常数且可当作一防反射光层的电容介电层材质可为一氮氧化硅(SiOxNy)，并且所形成的电容介电层的厚度小于10nm。关于电容的上电极板的制造步骤，它是利用一第一微影光罩将形成电容的上电极板的图案转移至涂布于电容介电层上的金属层的光阻，再利用一金属干式蚀刻步骤如一反应式离子蚀刻法(RIE)依据该图案蚀刻出电容上电极板与电容介电层。相似地，关于电容的下电极板的制造步骤，它是利用一第一微影光罩将形成电容的下电极板的图案转移至涂布于第一阻障层上的金属层的光阻，再利用一金属干式蚀刻步骤如一反应式离子蚀刻法(RIE)依据该图案蚀刻电容下电极板与第一阻障层。
该介层插塞的制造步骤，是以微影工艺步骤将用以形成电容上电极板与电容下电极板以及后续沉积的金属层连接位置的接点图案转移到覆盖在内金属介电层上方的光阻上而提供一第三微影光罩。接着以一干式蚀刻法将未被光阻所保护的内金属介电层加以去除，以形成数个介层窗(via hole)用以连接电容上电极板与电容下电极板以及后续沉积的金属层。接下来以具有回蚀刻的钨插塞制作步骤将介层窗以金属钨填满后，便形成介层插塞。
而在第二阻障层与最上方的金属层依续沉积完成后，以一第四微影光罩将欲形成的金属导线层的图案转移至涂布于最上方的金属层的上的光阻，再以一干式蚀刻步骤如一反应式离子蚀刻法(RIE)蚀刻出所想要的金属层，以便进行后续的配线步骤(wiring process)。
为进一步说明本发明的目的、结构特点和效果，以下将结合附图对本发明进行详细的描述。
(4)
图1至图6为根据本发明的一较佳实施例的图解包含MIM电容的集成电路装置的制作步骤的截面示意图。
(5)具体实施方式
本发明的包含高品质因子的金属-绝缘物-金属(MIM)电容的集成电路装置及其制造步骤，将由以下的实施例配合图示详细予以说明。以下所揭示的实施例，将可使熟悉本技术的人士根据所揭示的内容据以实施而完成本发明。然而本发明的实施，却非限于下述实施例的型态。
图1至图6为用以说明根据本发明的形成包含具有高品质因子的MIM电容的集成电路装置的步骤的截面图。如图1所示，一场氧化层(FOX)101沉积于一半导体基材100上方，它形成一半导体基材100的主动区域与隔离区域。半导体基材100可由一硅基材或一砷化镓基材形成。集成电路装置如晶体管，它所包含的源极、汲极、闸极是形成于该半导体基材100的主动区域中。一第一介电层102接着沉积于场氧化层101与半导体基材100上方。该第一介电层102可为一绝缘材质所组成的一内层介电层(inter-layer dielectrics，ILD)，如以传统的化学气相沉积法(CVD)所形成一硼磷硅玻璃(BPSG)，它提供形成于其上的导体层与半导体基材100之间的电气绝缘。
当第一介电层102沉积完成后，便通过施以具有回蚀刻的旋涂式玻璃制作步骤(SOG process with etch back)或化学机械研磨法(CMP)制作步骤来实现第一介电层102的平坦化。在第一介电层102的平坦化步骤完成后，以溅镀法(sputtering)于第一介电层102上方形成厚度约200-1000埃的第一阻障层(barrier layer)或粘着层(glue layer)103。较佳者，该第一阻障层103是由以溅镀法所形成的氮化钛(TiN)所组成。
在第一阻障层103形成后，于其上方沉积以钨(W)或铝(Al)所组成的一第一金属层104。该第一金属层104的厚度较佳者为约5000-10000埃。若选择钨为形成第一金属层104的材质，则是以传统的化学气相沉积法(CVD)沉积钨形成该第一金属层104。若选择铝为形成第一金属层104的材质，则是以溅镀法(Sputtering)沉积铝而形成第一金属层104。
当第一金属层104形成后，接着在第一金属层104上方沉积一厚度极薄(小于10nm)的第二介电层105。须特别注意的是，形成该第二介电层105的一材质不仅须具有良好的介电常数，其本身还可供作一防反射光层(anti-reflection coating，ARC)，用以在后续的微影步骤中，当作一防反射光层以避免光罩上的图案转移时造成误差。
在一般的VLSI制程中，为了要在金属或半导体装置的表面进行图案化(patterning)的步骤，以便于依据其表面的图案进行蚀刻成所要的形状，通常都会在金属或半导体装置的表面涂布一层光阻，再利用曝光技术将光罩上的图案显影于光阻上。但是，当以光源对金属或半导体装置曝光的过程中，穿透光阻层的光波会反射回来而形成一驻波强度图形。这将使得光罩上的图案转移至金属或半导导装置的表面时产生误差，导致生产的优良率降低。特别是于将光阻涂布于一具有高反射率的表面(如金属)，图案转移误差的问题会更严重。因此，现有技术用以解决图案转移误差的方法是利用一防反射光层(ARC)如氮化钛(TiN)来避免图案在转移时造成误差。
很不幸的是，氮化钛本身的介电常数不高，不适合当作介电材质来使用。因此在MIM电容的制作过程中，在沉积介电层后，还必须沉积一层氮化钛层当作防反射光层，以避免后续对金属的微影步骤发生错误。这样，制造成本必然会增加。而以氮氧化硅(Oxysinitride，SiOxNy)来当作介电材质它不但具有比二氧化硅更高的介电常数，并且还可作为一防反射光层。经过实际的MIM电容制作过程可以得知，若以氮氧化硅这种无机的材质来形成第二介电层105，并且适当地微调其厚度、折射指数n(refractive index)与消失系数k(extinguish coefficient)，该第二介电层105能够提供一个良好的线宽平整度摆动曲线(critical dimension swing curve)控制与消除在紫外线曝光步骤中所产生的驻波(standing wave)。在本发明的一较佳实施例中，该第二介电层105是由氮氧化硅这种无机的防反射光层所组成，但是其它可被应用为防反射光层且具有高介电常数的无机材质或是有机材质皆可被应用以形成该第二介电层105，而不脱本发明所欲保护的范围。
一第二金属层106，如一铝层，是以溅镀法沉积在第二介电层105上方。该第二金属层106接着以使用微影光罩与蚀刻步骤被图案化以提供一电容的上电极板。一光阻层接着被形成与被图案化于该第二金属层106上方，以提供一第一光罩107，其中具有一窗口且露出一部份的第二金属层106。第二金属层106与第二介电层105接着以该光阻图案107作为蚀刻罩幕进行金属干式蚀刻步骤，如一反应式离子蚀刻法(RIE)。被图案化后所形成的金属层106是作为电容上电极板，如图2所示。
如图2所描述，一光阻层接着被形成与被图案化于电容上电极板106上方，以提供一第二光罩108。第一金属层104与第一阻障层103接着以该光阻图案108作为蚀刻罩幕进行金属干式蚀刻步骤，如一反应式离子蚀刻法(RIE)。被图案化后所形成的金属层104是作为电容下电极板，如图3所示。
在图3中，在形成电容上电极板与电容下电极板后，一内金属介电层(inter-metal dielectrics，IMD)109，如以传统的化学气相沉积法(CVD)所形成一硼磷硅玻璃(BPSG)层或以等离子体辅助化学气相沉积法(PECVD)所形成的二氧化硅层被形成于电容上电极板106、电容下电极板104与第一介电层102的上方，它是用以隔离电容上电极板106与电容下电极板104以及后续沉积的金属层。接着，以微影步骤将用以形成电容上电极板106与电容下电极板104以及后续沉积的金属层连接位置的接点图案转移到覆盖在内金属介电层109上方的光阻层上而提供一第三光罩(未显示出)。接着以一干式蚀刻法将未被光阻所保护的内金属介电层109加以去除，以形成数个介层窗(via hole)110用以连接电容上电极板106与电容下电极板104以及后续沉积的金属层。接下来，以具有回蚀刻的钨插塞沉积步骤在介层窗110中形成钨插塞，而形成如图4所示的截面图。
在钨插塞110形成后，一第二阻障层111被沉积于钨插塞110上方，用以避免钨与其后形成于其上的金属层直接接触。该第二阻障层111较佳者亦为溅镀法所形成的氮化钛(TiN)所组成，如同第一阻障层103一般。一第三金属层112，较佳者为以溅镀法所沉积的铝所组成，被形成于第二阻障层111上方，如图5所示。一光阻层接着被形成与被图案化于该第三金属层112上方以提供一第四光罩113，其中具有数个窗口且露出一部份的第三金属层112。第三金属层112与第二阻障层111接着以该光阻图案113作为蚀刻罩幕进行金属干式蚀刻步骤，如一反应式离子蚀刻法(RIE)。所形成的集成电路装置的一截面图如图6所示。被图案化后所形成的金属层112将进行配线步骤(wiring process)用以埋入导线。由图6很明显可看出所形成的集成电路装置包含由电容下电极板104、电容介电层105与电容上电极板106所组成的薄膜电容，它可提供一优良的品质因子与较稳定的电容值。
本发明的包含MIM薄膜电容的集成电路装置利记博彩app，其特点是利用金属如铝或钨来形成MIM薄膜电容的上电极板与下电极板，且利用具有高介电常数的防反射光层(ARC)，如氮氧化硅(SiOxNy)来当作MIM薄膜电容的介电层材质。由于所选用的介电层材质本身亦可当作防反射光层，因此省去了在金属层的上方沉积一防反射光层的步骤，同时也减少了制程的复杂度且降低了制造的成本。同时，采用金属以取代现有的MIM电容以复晶硅形成电容的上电极板与下电极板，借以制造出具有高品质因子的MIM电容。因此，本发明克服了现有技术因采用复晶硅形成电容的电极板所造成较差的品质因子的缺陷，并且减少了制作过程的复杂度且降低了制造的成本，使得本发明具备了产业上的可利用性与高度的商业价值。
当然，本技术领域中的普通技术人员应当认识到，以上的实施例仅是用来说明本发明，而并非用作为对本发明的限定，只要在本发明的实质精神范围内，对以上所述实施例的变化、变型都将落在本发明权利要求书的范围内。
权利要求
1.一种集成电路装置，其特征在于，包括一半导体装置，于其中包含数个半导体元件；一第一介电层，形成于该半导体装置上方；一第一阻障层，形成于一部份的该第一介电层上方；一电容，形成于该第一阻障层上方，它由一电容下电极板、一电容介电层与一电容上电极板所组成，在其中该电容介电层是由具有较高的介电常数的防反射光层所组成；一内金属介电层，形成于该电容与该第一介电层上方；以及一金属层，形成于该内金属介电层上方，用以埋入导线。
2.如权利要求1所述的装置，其特征在于，该半导体装置包含一半导体基材；以及一场氧化层，形成于该半导体基材上方，它形成该半导体基材上所包含的该半导体元件的一主动区域与用以将每个半导体元件隔离开来的一隔离区域。
3.如权利要求2所述的装置，其特征在于，该半导体基材是由硅或砷化镓所组成。
4.如权利要求1所述的装置，其特征在于，该第一介电层是由一硼磷硅玻璃所组成。
5.如权利要求1所述的装置，其特征在于，该第一阻障层是由一氮化钛所组成，而该第一阻障层具有约200-1000埃的厚度。
6.如权利要求1所述的装置，其特征在于，该电容下电极板是由钨或铝所组成，而该电容下电极板具有约5000-10000埃的厚度。
7.如权利要求1所述的装置，其特征在于，用以组成该电容介电层的具有较高的介电常数的防反射光层为氮氧化硅，而该电容介电层具有小于10nm的厚度。
8.如权利要求1所述的装置，其特征在于，该电容上电极板是由铝所组成。
9.如权利要求1所述的装置，其特征在于，该内金属介电层是由硼磷硅玻璃与二氧化硅之一所组成。
10.如权利要求1所述的装置，其特征在于，还包括数个插塞，形成于该内金属介电层的内部，用以互相连接该金属层、该电容上电极板与该电容下电极板，而该插塞是由钨所组成。
11.如权利要求1所述的装置，其特征在于，还包括一第二阻障层，形成于一部份的该内金属介电层与该金属层之间，而该第二阻障层是由氮化钛所组成。
12.如权利要求1所述的装置，其特征在于，该金属层是由铝所组成。
13.一种制造集成电路装置的方法，其特征在于，包括下列步骤在一半导体装置上方形成一第一阻障层；在该第一阻障层上方形成一第一金属层；以具有较高的介电常数的防反射光层形成一第二介电层于该第一金属层上方；形成一第二金属层于该第二介电层上方；通过移除一部份的该第二金属层与该第二介电层且露出一部份的该第一金属层而产生一电容上电极板；通过移除一部份的该第一金属层与该第一阻障层且露出一部份的该半导体装置而产生一电容下电极板；形成一内金属介电层于该电容上电极板、该电容下电极板与该半导体装置上方；于该内金属介电层内形成数个插塞以连接该电容上电极板与该电容下电极板；形成一第二阻障层于该内金属介电层上方；形成一第三金属层于该第二阻障层上方；以及移除一部份的该第三金属层与该第二阻障层且露出一部份的该内金属介电层。
14.如权利要求13所述的方法，其特征在于，该半导体装置是由下列步骤所形成提供一半导体基材；形成一场氧化层于该半导体基材上方，它形成该半导体基材的一主动区域与一隔离区域；以及形成一第一介电层于该场氧化层与该半导体基材上方。
15.如权利要求14所述的方法，其特征在于，该第一介电层是由一化学气相沉积法接着一平坦化步骤所形成，而该平坦化步骤是由一具有回蚀刻的旋涂式玻璃制作步骤或由一化学机械研磨法步骤所完成。
16.如权利要求13所述的方法，其特征在于，该第一阻障层是由一溅镀法所形成、该第一金属层是由一化学气相沉积法所形成、而该第一金属层是由一溅镀法所形成。
17.如权利要求13所述的方法，其特征在于，移除一部份的该第二金属层与第二介电层而露出一部份的该第一金属层的步骤包括使用一第一光罩以图案化与蚀刻该第二金属层与该第二介电层的步骤，而蚀刻该第二金属层与该第二介电层的步骤是以一干式蚀刻法完成，且该干式蚀刻法为一反应式离子蚀刻法。
18.如权利要求13所述的方法，其特征在于，移除一部份的该第一金属层以及该第一阻障层而露出一部份的该半导体装置的步骤包括使用一第二光罩以图案化与蚀刻该第一金属层以及该第一阻障层的步骤，而蚀刻该第一金属层与该第一阻障层的步骤是以一干式蚀刻法完成，且该干式蚀刻法为一反应式离子蚀刻法。
19.如权利要求13所述的方法，其特征在于，该内金属介电层是由一化学气相沉积法或一等离子体辅助化学气相沉积法所形成。
20.如权利要求13所述的方法，其特征在于，该插塞是由下列步骤所形成以一微影步骤将该内金属介电层图案化以形成连接该电容上电极板与该电容下电极板的接点图案；依据所形成的接点图案而在该内金属介电层内部形成数个介层窗)；以及以一金属材质填满该介层窗。
21.如权利要求13所述的方法，其特征在于，形成该介层窗的步骤是以一干式蚀刻法完成，而该干式蚀刻法为一反应式离子蚀刻法，且该金属材质是为钨。
22.如权利要求13所述的方法，其特征在于，该第三金属层是由溅镀法所形成，而移除一部份的该第三金属层与第二阻障层而露出一部份的该内金属介电层的步骤包括使用一光罩以图案化与蚀刻该第三金属层与该第二阻障层的步骤。
全文摘要
本发明揭示一种包含高品质因子的金属－绝缘物－金属(MIM)电容的集成电路装置及其利记博彩app。本发明的包含MIM薄膜电容的集成电路装置，其特点是MIM电容的薄介电层是以一种具有相对高的介电常数且可被当作一防反射光层(anti－reflection coating，ARC)的材质所组成。因此在进行图案化MIM电容的电极板的制作时，便不需在金属层上方沉积一防反射光层，而直接以MIM电容的薄介电层作为防反射光层，省却在金属层上方沉积一防反射光层的步骤。
文档编号H01L21/70GK1449041SQ02105478
公开日2003年10月15日 申请日期2002年4月2日 优先权日2002年4月2日
发明者刘萍 申请人:华邦电子股份有限公司