专利名称：可伸缩的数据处理设备的利记博彩app
技术领域：
本发明涉及一种可伸缩的数据处理设备，具体地说，本发明涉及一种数据存储设备，该设备包括一个或多个薄层器件，这些器件构成了由多个薄膜子层形成的基本上为平面的层，其中，所述薄膜子层包括电绝缘和/或导电和/或半导电结构以及在子层中用薄膜材料来实现的具有信息存储能力的结构，所述结构与相邻子层中的其它这种结构相对齐或作电接触，以便实现薄膜器件中的有源和无源的电路元件或逻辑单元，薄膜器件中的有源和无源电路部件是用三维结构来实现的并且穿过两个或多个子层，所述电路部件与一个或多个子层中的水平导电结构以及穿过一个或多个子层的垂直导电结构作电连接，并且，将两个或多个薄膜器件设置成构成所述的薄膜器件的基本上为平面的层的叠置堆，因此，所述设备构成了一叠置结构。
本技术中周知是形成呈叠置结构中的薄膜电路形式的存储器，并且，存储器还可与用于控制、驱动并对存储器进行寻址的处理器相结合，另一方面也可按单晶体刚性基层(substrate)和/或设置在载体基层上的薄膜的形式与用无机半导电材料实现的处理器相结合，所述载体基层非常薄，例如形成为二氧化硅薄膜。通过将所述的层并置且通常用特殊的方法转印上述薄膜电路来形成带有处理电路的完整存储器。为了提供所述层之间的互连，使用了层上的成组开孔，这些开孔可与金属的蒸发相结合，以形成必要的电流通路。从PCT/NO99/00180中已知有集成的可伸缩数据处理器，该处理器构成了带有海量存储器以及处理器与存储器组合模块的完整计算机，该计算机内，在独立的处理器层或独立的存储器层或处理器与存储器组合层上设置有所谓的智能随机存取存储器(IRAM)以及实现计算机CPU功能或实现计算机中控制和通讯功能的处理器，上述专利属于本申请人，本文引用了该专利。为了提供短路路径，用三维电学结构来形成独立层内的组件之间以及层之间的互连。整个数据处理器设置在基层上，该基层还包含有用于进行控制和通讯的高速处理电路，这些电路是用无机半导电材料按通常技术实现的，而数据处理器的不同的层整个都是用薄膜技术来实现的，而不管这些层是涉及处理器还是存储器。
即使在本技术中以使用薄膜技术为基础的用于数据处理和存储的周知器件就速度和功能而言具有多种优点，但它们就纯粹的存储目的来说通常有非常高的成本并且生产起来特别复杂。有效的存储器管理还需要显著的处理能力，例如，就控制、通讯和寻址而言，用于这些目的的专用电路通常分配给有较大存储器能力的大型存储器或若干个独立的存储器。
本发明的主要目的是提供一种可伸缩的数据处理设备，具体地说是提供这样一种数据存储设备，它较为简单、制造廉价，通常在不使存储器管理和操作变得复杂的情况下允许对数据存储能力作几乎无限制的伸缩。
本发明的另一个目的是实现一种可伸缩的数据处理设备，具体地说是基本上用薄膜技术来实现这样一种数据存储设备，它能实现用于对用薄膜技术实现的存储器进行控制和寻址的支持功能，用于上述目的的电路与所述薄膜器件中的存储器成整体。
最后，本发明的还一个目的是实现一种有大存储密度、快速数据访问和高数据传输率的体积数据处理器，它可有选择地与数据存储器中的并行数据输入和从数据存储器中的数据快速读出相结合。
依照本发明用可伸缩的数据处理设备特别是用这样的数据处理设备可实现上述和其它目的，所述数据处理设备的特征在于，每个薄膜器件均包括一个或多个存储器区，该区构成了一个或多个矩阵式可寻址存储器，每个可寻址存储器均具有位于子层内的存储器介质，它与呈条状平行导电结构或电极结构形式的第一电极组及呈基本上与第一电极组中电极结构相垂直定向的相应电极结构形式的第二电极组作接触，所述电极组分别设置在与所述子层相邻的另一子层的各侧面上，从而，用存储器介质在第一与第二电极组中电极结构之间的交叉处形成可寻址的存储器单元，每个薄膜器件还包括电路区，该区构成了用于控制、驱动并对一个或多个存储器中存储器单元进行寻址的薄膜电路，所述电路通过电流通路与存储器中相应的第一和第二电极组中的电极结构相连，所述电流通路是在位于其中设置有电极的基本上相同子层内的导电结构，各薄膜器件具有与所述设备中每个其它的薄膜器件的相应接口，所述接口是用通讯和信号线及用于处理的支撑电路来实现的，所述支撑电路垂直穿过薄膜器件上的相应专用接口区。
在本发明设备的一个最佳实施例中，所述一个或多个存储器中的存储器介质它括从呈单体、低聚体或聚合体、无机或有机含碳材料形式的分子材料或者这些材料的并置物或混合物中选出的材料。这方面，存储器介质最好包括能在存储器单元中提供非线性电流/电压特征的存储器材料，所述非线性电流/电压特征是由无机或有机二极管或阈值可转换的材料产生的。
在本发明设备的另一个最佳实施例中，所述存储器介质包括可转换的材料，这种材料是一种非易失材料，它分别被选定为铁电材料或电荷转换有机复合体，或者，所述存储器介质可以是可转换的并具有非线性电流/电压特征。
最佳的是，依照本发明，所述电路包括无机和/或有机半导电材料。
在本发明设备的一个最佳实施例中，所述一个或多个薄膜器件中的接口区设置成包括在该器件的边缘部分内，所述边缘部分在有多个器件的情况下是相互对齐的。在这方面，边缘部分中的接口区最好还包括用于相应薄膜器件或有选择地用于所述设备整体的I/O接口并且能实现用于与外部和/或外围设备作数据和信号通讯的功能。
最佳的是，在本发明的设备中，薄膜器件或这些器件的叠置结构可以是这样的即薄膜器件或这些器件的叠置结构设置在基层上，所述基层包括用于实现前述设备中其它控制、驱动和通讯功能的有源电路，每个薄膜器件均在一独立的接口区上与一电路相连，所述独立接口在每种情况下都垂直地穿过位于上述薄膜器件与基层之间的那些薄膜器件。这方面，所述基层最好包括一接口部分，该接口部分在所述基层上基本上水平地延伸并平行于且相邻于设置在上方的薄膜器件，所述接口部分与薄膜器件或设置在基层上方的薄膜器件中的接口部分作电连接，并且，特别是，所述接口部分最好还包括用于所述整个设备的I/O接口，该I/O接口可实现与外部和/或外围设备作数据和信号通讯的功能。
最佳的是，所述基层是用半导电材料具体是用无机单晶体半导电材料更具体说是用硅这种单晶体半导电材料制成的，这方面，具体地说，所述基层上的电路最好是用CMOS技术实现的。这方面，所述基层上的电路与接口部分之间的或如上设置的薄膜器件中的接口区的接口部分上的电连接被实现为CMOS兼容的金属互连。
在本发明设备的一个最佳实施例中，所述设备包括两个或多个薄膜器件，这些薄膜器件在平面内基本上是共形的并且设置成在叠置结构内相互对齐。这方面，一个或多个分隔层最好在相邻的薄膜器件之间设置成层状并分别以独立的方式或以有选择的组合的方式实现电、热、光或机械隔离功能或平面化功能，相应薄膜器件中所述的接口区在各种情况下都在相应的分隔层的通路上作电连接。
在本发明设备的另一个最佳实施例中，所述设备包括两个或多个薄膜器件，这些薄膜器件设置或在叠置结构中相互交错。这方面，一个或多个分隔层最好在相邻的薄膜器件之间设置成层状并分别以独立的方式或以有选择的组合的方式实现电、热、光或机械隔离功能或平面化功能，所述分隔层仅设置在两个相邻的薄膜器件的重叠部分上，相应薄膜器件的接口区设置在其交错区的薄膜器件的外露表面部分的上方，因此，薄膜器件之间的分隔层在没有用于独立薄膜器件之间电连接的通路的情况下构成了不折断的层。
最后，本发明的设备可最佳地设置在一载体基层上，该基层由箔状材料或诸如硅之类的刚性材料构成，所述的载体基层在各种情况下都设置成与叠置结构中的最下部薄膜器件相邻或者有选择地配备带有电路的基层。
以下参照示例性实施例和附图详细说明可伸缩的数据处理设备具体说是本发明的数据存储设备，在附图中
图1a示出了本发明设备中使用的薄膜器件的平面图；图1b示出了沿A-A线经过图1a的薄膜器件的第一实施例的剖面；图1c示出了沿A-A线经过图1a的薄膜器件的第二实施例的剖面；图2a示出了本发明设备中使用的薄膜器件的第三实施例的平面图；图2b示出了沿B-B线经过图2a的薄膜器件的剖面；图3a示出了本发明设备中使用的薄膜器件的第四实施例的平面图；图3b示出了沿C-C线经过图3a的薄膜器件的剖面；图3c示出了沿D-D线经过图3a的薄膜器件的另一个剖面；图4概略且以透视的方式示出了图1-3之一的薄膜器件中所使用的矩阵式可寻址存储器的一个实施例；图5a示出了图4中与图1-3之一所示的薄膜器件中的有源电路相连的矩阵式可寻址存储器的平面图；图5b示出了沿E-E线经过图5a的存储器概略剖面；图6a示出了本发明设备的第一实施例；图6b示出了本发明设备的第二实施例；图6c示出了本发明设备的第三实施例；图7示出了本发明设备的第四实施例；图8a和8b示出了本发明设备的第五实施例的变化形式；图9概略地示出了用薄膜技术将子层加进本发明使用的薄膜器件以及将多个这种薄膜器件加进本发明的设备；以及图10概略地示出了本发明设备的主要组件是分解了的最佳实施例。
本发明的主要目的是提供一种数据存储器，所以，本发明的设备在以下被认为是实现了一存储器并被称为“设备”。本发明的基础是，按相邻且基本平行的叠置层的形式来实现所述的设备，这些叠置层中的每一个都被形成为一薄膜器件，该薄膜器件由多个有特定不同功能且可用不同材料制成的薄膜子层构成。
图1a中以平面图的方式示出了本发明中所使用的薄膜器件1。薄膜器件1被分别组织在电路区2、存储器区3和接口区4内。在图1b内，示出了沿A-A线经过图1c的薄膜器件的剖面。示出了包含有用薄膜技术实现的存储器3’的存储器区3设置在电路区2内，电路区2包含有基于薄膜的电路，它用于实现对存储器的控制、通讯和寻址功能。根据存储器类型的不同，所述寻址功能例如包括在存储器中进行写、读和删除以及在接口区4上与存储器相通讯。图1c示出了沿A-A线经过图1c的薄膜器件的剖面，但是，在图1b以外的另一个实施例中，示出了存储器区3在电路区2内带有重直叠置但被电绝缘层5隔离的薄膜存储器3’。这方面，应该认识到，正如以下将详细地说明的那样，每个独立的存储器3’当然也由多个独立的子层构成，而且，在接口区4上未具体示出的电路区2中的电路不仅用于对独立薄膜器件中的存储器进行控制和寻址，而且用于与以相邻方式设置的薄膜器件1中的相应电路及其它存储器进行通讯。
正是在这种情况下，每个独立的薄膜器件1均由众多数量的子层一般例如数十个子层构成，而独立存储器3’不需要包括四至五个以上的子层，这就允许如图1c所示那样垂直地或者如在图2a的平面图和在沿图2a的B-B线的呈剖面形式的图2b所示的另一个最佳实施例中叠置起多个存储器。薄膜器件1中的独立存储器3’也设置成叠置的，但是相交错的。在图2a和2b中，示出了具有四个存储器3’且由电绝缘层5相互隔离的四个存储器叠置体。仅用标号3’来分别表示各叠置体中的最下部和最上部存储器。
图3a中示出了本发明所使用的薄膜器件1的另一个实施例，它基本上对应于图2a中的实施例并具有由交错的存储器形成的存储器叠置体，但这种叠置体是沿对角线出现的，如在图3a的平面图、图3b中沿图3a的C-C线的剖面和图3c中的中沿图3a的D-D线的剖面所示。就更好地利用电路区2中的实际区域，分别在图2a和图3a中所示的叠置体中的存储器结构是最佳的，而交错则可以简化存储器与电路区2中的电路之间的互连。当然，应该认识到，电路区2中的存储器区3内的存储器3’的相互结构基本上不限于某种特定的几何形状，而是可在薄膜器件1的实施例和构成因素给出的边界内有所变化。
图4概略地示出了基本上是无源的矩阵式可寻址存储器3’的实施例。例如在PCT/NO98/00185中公开了这种存储器，该专利属于本申请人，本文引用了该专利。在图4中，存储器介质6设置在相应的由平行条状电极7构成的基底电极组与由平行条状电极8构成的覆盖电极组之间。通过将电压分别加载于基底与覆盖电极7、8，可在存储器介质6中位于电极间交叉处获得状态变化，这种变化例如可用存储器介质中的阻抗的变化来表示。存储器介质6本身最好由分子材料或含碳的无机或有机材料制成。通常，存储器介质应该有非线性的阻抗特征，并且，通过对形成在基底电极7与覆盖电极8之间交叉处的未示出存储器单元进行寻址，能阻止产生所谓的流向存储器矩阵中其它存储器的潜行电流。通过提供有整流性质的存储器介质最好是通过包括构成二极管结的层或通过本身用电极材料自然形成二极管结的存储器介质6来实现这一点。
如果存储器材料6是聚合物，则其信息存储能力取决于它在加载了电流或电压下的阻抗值的变化以及在断掉电流或电压后保持这种变化的阻抗。所述存储器还可以是可转换的材料，例如是呈聚合物形式的铁电材料，这些材料的极化状态可表示确定的逻辑状态，或者，所述存储器可以是诸如M(TCNQ)之类的电荷传递金属有机复合体。一般地说，在本技术中，周知有可用于矩阵式可寻址存储器的多种不同存储器材料，并且，在这方面例如涉及到上述文件PCT/NO98/00185。在图4中，存储器设置在中间，但是，这并不是必要条件，而是完全可能使用其它的电极结构，例如使用如属于本发申请人的PCT/NO98/00185所公开的桥结构，其中，基底电极7与覆盖电极8在交叉处相互绝缘，并且，存储器材料6设置在电极上，当然，在这种情况下，需要存储器材料必须具有确保其信息存储容量的性质。一般地说，这种情况下的存储器材料可以是共扼聚合物。
图5a的平面图中概略地示出了存储器3’与电路区2中电路9之间的互连。矩阵中的各个电极6、7通过字和位线路10与电路9相连。在沿图5a的E-E线的剖面中，图5a中形成为薄膜器件1中的子层S1-S8的结构会表现为如图5b所示，在图5b中，示出了两个叠置的存储器3’1、3’2以及整个都用薄膜技术实现的电路9。具体地说，可以看出，用于存储器3’的电流路径和导体路径即基底和覆盖电极7、8以及将这些电极连接于电路9的线路10基本上都设置在同一子层上例如S2、S4、S6或S8上，可按目地更容易地产生呈一个或同一子层上的导电结构形式的这种电流路径和导体路径。
图6a示出了如果将多个薄膜器件1在本例中为三个薄膜器件加进叠置结构。如以前一样，用标号2表示电路区，用标号3表示存储器区，并且，在图中示出了相互对齐，但这并不是必要条件。接口区4设置在电路区的侧面并相应地对齐，薄膜器件1之间的电连接用箭头4’来概略地表示并且垂直穿过接口区4。此外，接口区4可带有I/O接口12，接口12将薄膜器件1与未示出的用于输入和输出数据的外部设备或外围设备连接接起来。
图6b示出了处于叠里结构的薄膜器件1，该器件设置在带有有源电路14的基层13上。这种基层是用无机半导电材料例如硅或硅的异形体来实现的，并且，所述有源电路例如是用CMOS技术来实现的。基层13中的有源电路14用于在对薄膜器件中的存储器进行管理时的控制和通讯任务并可与薄膜器1的电路区2中的薄膜电路相配合，这就会为存储器在薄膜器件1中留出更多的空间，因为，电路区2中的薄膜电路在这种情况下被限于为保持对存储器进行有效的控制和驱动所必需的，而例如对存储器的数据输入和输出和校错、存储器再映射等处理任务则可由用基层内的有源电路14加以实现的处理器来处理。叠置薄膜器件中的接口区4内的垂直互连4’与基层13上的接口部分15相通连，可例如用形成在接口部分15中的金属通路来提供经过上述接口部分的且位于电路14与垂直互连4’之间的电连接，但是如果在基层上设置了CMOS电路，则以上需在CMOS兼容的处理过程中进行。I/O接口12设置成与基层的接口15相连，而不是将I/O接口形成在叠置薄膜器件中的接口区4内。
图6c中示出了本发明设备的另一个实施例。如前所述，薄膜器件按叠置结构设置在基层13上，但是，设置独立的接口区4以便在薄膜器1之间和在薄膜器1与基层13的接口15之间形成垂直的互连，而不是将薄膜器件1的接口区4设置在边缘部分。这会有助于独立薄膜器件中的在拓扑学上被看作是最佳的结构并减少对水平电流路径的需要。
在图6c的实施例中的一个变化形式中，可如图7所示那样实现所述设备。分隔层16设置在各薄膜器1之间，例如从NO专利申请书980781中周知有所述分隔层，所述申请书属于本申请人，本文引用了该申请书，这些分隔层可独立地或者以有选择的组合方式实现例如电、热、光或机械隔离功能。在叠置的结构中，这些分隔层还可用作极化层。但是，当如图7所示那样设置薄膜器件1中的接口区4时，先决条件是这些接口区要穿过隔离层16，并且，这一点必须通过在隔离层中例如呈通路形式的互连来做到，就隔离功能而言，有些事情是有害的并还会导致成本有所增加的生产步骤。避免这一点的一种方式是如前所述那样在叠置结构中设置相交错的薄膜器件1。
图8a示出了一个实施例，其中，薄膜器件设置在基层13上并被分隔层16所相互分隔，但是，接口区4设置在基层13的接口15之间且设置在薄膜器件的一侧的外露阶梯上。分别用水平和垂直的互连4’来概略地指示薄膜器件1之间或薄膜器件与基层15之间的互连。
在图8a的实施例中，在叠置结构的相反一侧将一未示出的载体基层设置成与薄膜器件1相邻。在生产过程中，薄膜器件1的结构相对未示出的载体基层向上，此后，如在生产过程中的最后步骤那样，将带有有源电路14的基层13设置在叠置结构的顶部。这就意味着，在前一生产步骤中设置薄膜器件1之后来实现接口区4上的互连以及与接口部分15的互连，就形成这种互连的成本和简单性而言，某些事情在多数情况下是最佳的。
图8b示出与图8a大致对应的实施例，其中薄膜器件1设置成由分隔层16相互分隔并且设置成在叠置结构中相交错，因此，最靠近基层13的薄膜器件1不会盖住整个结构，但会构成直至基层表面的阶梯。接口区4可设置在叠置结构中阶梯部的上方，薄膜器件1之间或薄膜器件与基层13中的接口15之间的互连在叠置结构中的阶梯上水平且垂直地延伸。
图9相当概略地示出了各独立的薄膜器件11、12、13是如何由多个子层这里显示为四层S1-S4构成的。可通过转换子层s中的薄膜材料将水平的相互电连接形成为这一子层s中的整体部分，并且，可通过使导电材料位于薄膜中的部分对齐而相应地形成经过子层s的垂直导电互连。在特定的条件下，可在已形成的薄膜叠置体中的原位处形成这种导电或半导电结构，或者，可在各个独立层s中独立地形成上述结构，然后将各独立的层层压进或以别的方式加进构成薄膜器件1的叠置体中。在属于本申请人的PCT/NO99/00023中，说明了一种通过幅射例如光幅射或粒子幅射在原位形成水平和垂直导电结构以便在叠置的薄膜器件中形成三维导中或半导电结构的方法，本文引用了上述专利。但是，也可用通过特殊发生器/调制器而作用于独立子层s的电场来形成上述结构，属于本申请人的PCT/NO99/00022说明了这种情况，本文引用了该专利。
图10以分解的方式示出了本发明设备的主要组件，在图10中，所述设备带有三个薄膜器件11、12、13以及设置在薄膜器件的边缘部的接口区4。示出了图10的设备使用了基层13，该基层包括未示出的有源电路和接口15并构成了用于整个设备的I/O接口12。但是，在本发明设备中使用这种基层13并不是先决条件，薄膜器件1的叠置结构也可以仅设置在无源载体基层上，该基层例如由箔状材料或诸如硅之类的刚性材料构成。
图10的实施例具有与上述国际专利申请书PCT/NO98/00185所示相应实施例相类似的特征。在上述专利申请书中，详细地公开了矩阵式可寻址存储器装置，该装置适用于本发明的设备，并且，还公开了如何在叠置的薄膜层中用三维拓扑结构来实现电路。这种电路例如涉及到二极管、三极管、互补三极管电路和用薄膜技术实现的逻辑门、这里未作详细说明的某些内容。应该认识到，独立薄膜器件中的存储器可配置成多种处理器类型中的一种或多种即RAM、ROM、WORM、ERASABLE或REWRITEABLE或者这些存储器的组合。在上述专利申请书中也详细地公开了这一点，所以本文不再作进一步的说明。
本发明设备中的各薄膜器件1可在加进叠置结构之前构建在专有分隔层16上。薄膜器件1中的独立子层可具有1μm以下的厚度例如低至0.1μm，这意味着设置在载体基层或对应于分隔层16的基层上的薄膜器件1连同独立子层构成了厚度例如为20μm的组件并且在这种情况下包括高达100个子层，这足以能用薄膜技术来实现较为复杂的电路并同时使得数十个独立存储器3’叠置进各存储器区3。就1μm2的存储器单元而言，1cm2的单个存储器可包括108个这种类型的存储器，从而能存储至少108位。信用卡大小的薄膜器件例如包括40个这种独立存储器，从而能存储0.5GB。当例如可实现为厚度为3mm的类似PCMCIA的卡的设备包括100个叠置薄膜器件时，可以看出，所述设备可在所述构成要素给定的条件下存储50GB。通过更好地利用各薄膜器件的实际区域即增加存储器区3的尺寸且通过减少独立存储器单元的尺寸，可获得更多的存储容量。因为，至少下降至0.25μm×0.25μm的尺寸是合理的。在这种情况下，存储容量可直接增加至800GB，可以看出，按上述方式实现的本发明设备可实现海量存储器或硬盘替代物，它可在当今大多数个人计算机或工作站中使用。
在遵循给定数据存储密度的情况下，可以看出，总数据存储密度由上述构成因素即所述设备的面积和厚度给出。可用足够数量的薄膜器件来实现理论上和实践上对设计存储容量的伸缩。在被集成进例如PCMCIA卡3中的情况下，本发明的设备可代替卡内的通常硬盘存储器。在给定标准不对尺寸有限制时，本发明设备能在例如个人计算机中代替现有的硬盘解决方案并能以适当伸缩的方式提供TB级的海量存储容量。
最后，应该指出，即使以平面叠置结构实现了本发明的设备，但也可以想到，所述叠置结构可形成有不同的几何形状。由于薄膜是用挠性材料制成的，并且，如果未使用带有有源电路并以无机半导体为基础的基层而例如仅是呈箔状材料形式的挠性载体基层，那么，可以想到，如果就上述目的而言是最佳的，则整个设备例如可卷成一柱形或管状结构。在任何情况下都很明显，用挠性材料实现的本发明设备可包括在其它对象内，其中，对平面度或硬度的要求不再是不可避免的，从而所述设备可用于在与通常计算机技术范围内完全不同的情况下实现应用。
权利要求
1.一种可伸缩的数据处理设备，具体说是一种数据存储设备，该设备包括一个或多个薄层器件，这些器件构成了由多个薄膜子层形成的基本上为平面的层，其中，所述薄膜子层包括电绝缘和/或导电和/或半导电结构以及在子层中用薄膜材料来实现的具有信息存储能力的结构，所述结构与相邻子层中的其它这种结构相对齐或作电接触，以便实现薄膜器件中的有源和无源的电路元件或逻辑单元，薄膜器件中的有源和无源电路部件是用三维结构来实现的并且穿过两个或多个子层，该电路部件与一个或多个子层中的水平导电结构以及穿过一个或多个子层的垂直导电结构作电连接，并且，将两个或多个薄膜器件设置成成整体的一叠基本上为平面的层，它构成了该薄膜器件，因此，所述设备构成了一叠置结构，所述数据处理设备的特征在于，每个薄膜器件均包括一个或多个存储器区，该区构成了一个或多个矩阵式可寻址存储器，每个可寻址存储器均具有位于子层内的存储器介质，它与呈条状平行导电结构或电极结构形式的第一电极组及呈基本上与第一电极组中电极结构相垂直定向的相应电极结构形式的第二电极组相接触，所述电极组分别设置在与所述子层的两面相邻的另外子层上，从而，用存储器介质在第一与第二电极组中电极结构之间的交叉处形成可寻址的存储器单元，每个薄膜器件还包括电路区，该区构成了用于控制、驱动并对一个或多个存储器中存储器单元进行寻址的薄膜电路，所述电路在电流通路上与存储器中相应的第一和第二电极组中的电极结构相连，所述电流通路被形成为位于其中设置有电极的基本上相同子层内的导电结构，各薄膜器件具有与所述设备中每个其它的薄膜器件的相应接口，所述接口是用通讯和信号线及用于处理的支撑电路来实现的，所述支撑电路垂直穿过薄膜器件上的相应专用接口区。
2.如权利要求1的设备，其特征在于，一个或多个存储器中的存储器介质它括从呈单体、低聚体或聚合体、无机或有机含碳材料形式的分子材料或者这些材料的并置物或混合物中选出的材料。
3.如权利要求2的设备，其特征在于，所述存储器介质包括能在存储器单元中提供非线性电流/电压特征的存储器材料，所述非线性电流/电压特征是由无机或有机二极管或阈值可转换的材料产生的。
4.如权利要求1的设备，其特征在于，所述存储器介质包括可转换的材料，这种材料是一种非易失材料，它分别被选定为铁电材料或电荷转换有机复合体。
5.如权利要求1的设备，其特征在于，所述存储器介质是可转换的并具有非线性电流/电压特征。
6.如权利要求1的设备，其特征在于，所述电路包括无机和/或有机半导电材料。
7.如权利要求1的设备，其特征在于，所述一个或多个薄膜器件中的接口区设置成包括在该器件的边缘部分内，所述边缘部分在有多个器件的情况下是相互对齐的。
8.如权利要求7的设备，其特征在于，所述边缘部分中的接口区还包括用于相应薄膜器件或有选择地用于所述设备整体的I/O接口并且能实现用于与外部和/或外围设备作数据和信号通讯的功能。
9.如权利要求1的设备，其特征在于，所述薄膜器件或这些器件的叠置结构设置在基层上，所述基层包括用于实现前述设备中其它控制、驱动和通讯功能的有源电路，每个薄膜器件均在一独立的接口区上与一电路相连，所述独立接口在每种情况下都垂直地穿过位于上述薄膜器件与基层之间的那些薄膜器件。
10.如权利要求9的设备，其特征在于，所述基层包括一接口部分，该接口部分在所述基层上基本上水平地延伸并平行于且相邻于设置在上方的薄膜器件，所述接口部分与薄膜器件或设置在基层上方的薄膜器件中的接口部分作电连接。
11.如权利要求10的设备，其特征在于，所述接口部分还包括用于所述整个设备的I/O接口，该I/O接口可实现与外部和/或外围设备作数据和信号通讯的功能。
12.如权利要求11的设备，其特征在于，所述基层是用半导电材料具体是用无机单晶体半导电材料更具体说是用硅这种单晶体半导电材料制成的。
13.如权利要求12的设备，其特征在于，所述基层上的电路最好是用CMOS技术实现的。
14.如权利要求10和权利要求13的设备，其特征在于，所述基层上的电路与接口部分之间的或位于上层的薄膜器件中的接口区的接口部分上的电连接被实现为CMOS兼容的金属互连。
15.如权利要求1的设备，所述设备包括两个或多个薄膜器件，其特征在于，这些薄膜器件在平面内基本上是共形的并且设置成在叠置结构内相互对齐。
16.如权利要求15的设备，其特征在于，一个或多个分隔层在相邻的薄膜器件之间设置成层状并分别以独立的方式或以有选择的组合的方式实现电、热、光或机械隔离功能或平面化功能，相应薄膜器件中所述的接口区在各种情况下都在相应的分隔层的通路上作电连接。
17.如权利要求1的设备，所述设备包括两个或多个薄膜器件，其特征在于，这些薄膜器件设置或在叠置结构中相互交错。
18.如权利要求17的设备，其特征在于，一个或多个分隔层在相邻的薄膜器件之间设置成层状并分别以独立的方式或以有选择的组合的方式实现电、热、光或机械隔离功能或平面化功能，所述分隔层仅设置在两个相邻的薄膜器件的重叠部分上，相应薄膜器件的接口区设置在其交错区的薄膜器件的外露表面部分的上方，因此，薄膜器件之间的分隔层在没有用于独立薄膜器件之间电连接的通路的情况下构成了不折断的层。
19.如权利要求1的设备，其特征在于，所述设备设置在一载体基层上，该基层由箔状材料或诸如硅之类的刚性材料构成，所述的载体基层在各种情况下都设置成与叠置结构中的最下部薄膜器件相邻或者有选择地配备带有电路的基层。
全文摘要
在一种可伸缩的数据处理设备中,具体地说,在一种数据存储设备中,构成一基本上为平面层的一个或多个薄层器件包括多个薄膜子层。两个或多个薄膜器件设置成由构成上述薄膜器件的基本上为平面的层所形成的成整体的叠置体,因此,所述设备构成了一叠置结构。每个薄膜器件均包括:一个或多个存储器区,该区构成了矩阵式可寻址存储器;以及,电路区,该区构成了用于对一个或多个存储器中的存储器单元进行控制、驱动和寻址的薄膜电路。每个存储器均具有与所述设备中其它的每个一个薄膜器件的接口,所述接口是用通讯和信号线及用于处理的支撑电路来实现的,所述支撑电路垂直穿过薄膜器件上的相应专用接口区。
文档编号G11C13/00GK1334963SQ99816048
公开日2002年2月6日 申请日期1999年12月3日 优先权日1998年12月4日
发明者H·G·古德森, P·E·诺达尔, G·I·莱斯塔德, R·M·贝尔格伦, J·R·A·卡尔松, B·G·古斯塔夫松 申请人:薄膜电子有限公司