专利名称：信息安全集成电路可测性与安全性设计方法
技术领域：
本发明属于集成电路设计技术领域，特别是涉及信息安全领域的集成电路的可测性与安全性设计。
背景技术：
随着计算机技术、通信技术和微电子技术的迅速发展，信息成为推动社会发展的巨大动力。它在国家的政治、军事、外交等非民用领域中有着非常重要的地位，同时与金融、商业、经济等民用领域也密切相关。为了保护关键信息的安全，采用密码技术是一种常见和有效的方法。为了加快处理速度和提高安全性，使用专用信息安全集成电路实现特定的密码算法是一种有效的技术。
在超大规模集成电路中，为了帮助进行产品的分析和测试，通常会加入可测试性设计支持(如扫描链等)，以便能对电路的内部节点进行访问，这样当电路出现故障时可以分析查找故障的原因。可测试性设计的基本思想是提高电路的可控制性与可观察性，以便为电路提供激励和观察电路的响应，但是对信息安全集成电路来说，由于可以读出内部信号和状态的测试方法可能被用于分析电路内部的工作情况，从而带来安全性方面的问题，因此是不能采用的。实际上，在信息安全集成电路的设计中，应当保证在整个处理完成之前的中间结果对外界都是不可访问的，以免攻击者利用这些信息对算法的处理过程进行分析，因此在信息安全集成电路中，可测试性和安全性之间存在着一定的矛盾。目前的设计技术尚未见到对此问题的解决方法。
发明内容
本发明克服了上述信息安全集成电路的可测试性与安全性的矛盾，提供一种信息安全集成电路的可测性与安全性设计方法，既可实现集成电路的可测试性，又使攻击者难以获得具体的电路信息。
本发明的技术内容一种信息安全集成电路的可测性与安全性设计方法，其步骤包括1、根据需要，确定测试的观察点并设计与观察点相对应的电路探测点；2、采用自动布局布线工具实现观察点和探测点的连接；
3、在测试时，利用探针和电路探测点检测信息安全集成电路的相关信息。
设置缓冲器电路驱动从探测点到观察点的连线。
为了方便设计过程，探测点可设置在压点单元中，作为压点单元的信号点。
本发明的技术效果在信息安全集成电路的物理版图中，对需要进行测试的观察点通过连线连接到可以用探针进行探测的探测点上，实现了电路的可测试性，新加入的连线和压点没有改变原来的逻辑，因此不影响电路的可控制性；攻击者在对电路结构不了解的情况下，难以分析信号的具体含义，在电路的版图中这些新加入的连线对电路逻辑功能来说是冗余的连线，对攻击者使用反向工程方法进行攻击设置了障碍。通过这种方法在信息安全集成电路的可测试性和安全性之间取得了较好的折中，对芯片的面积、速度、功耗等其他性能的影响也很小。
下面结合附图，对本发明做出详细描述。
图1为本发明信息安全集成电路的可测性与安全性设计的示意图。
具体实施例方式
在集成电路的测试中，可以通过探针探测集成电路芯片上的信号，前提是这些信号的探测点1尺寸足够大，可以被探针探察，而且探测点1暴露在集成电路加工的钝化层外。因此探测点1应当采用集成电路加工工艺的顶层金属设计，并且设计足够的尺寸以便通过探针进行检查。
需要观察的信号可以根据实际需要选择。观察点1和测试点3之间的对应关系在进行电路设计时确定，这种对应关系和电路本身的结构有密切的关系，而且只在进行测试分析时才会用到，因此是保密信息，在不知道电路结构的情况下分析这种对应关系的难度是比较大的。
对需要进行观察的节点，为了保证不会因为探针的作用而引起错误，可以通过缓冲器电路2来隔离，保证探测点1会得到来自观察点3的驱动，而不会有反向的信号传递，从而避免了对原始观察点的影响。
为了进一步增加这些观察点中信号连线5带来的冗余和混乱效果，以增强电路的抗攻击能力，在版图设计中使用自动布局布线工具进行电路的设计，由它完成电路中各种单元和连线的安排。为了保证可以通过自动布局布线工具设置和连接这些探测点1，可以把它们与电路的压点单元4设计在一起，并作为压点单元4中需要连接的信号点。这些电路中的冗余连线会给版图的反向工程分析增加难度。由于自动工具设计和人工设计采用的方式不一致，因此当进行反向工程分析时会进一步增加分析的困难，从而提高电路的安全性。
若需要知道电路中观察点的逻辑值时，只需要通过探针检查相对应的探测点的情况即可。
本发明在电路设计中不改变电路的设计流程和使用的工具，并利用这些工具增加了反向工程分析的难度。这种方法不会改变电路的功能，不增加额外的控制信号，对集成电路的速度和功耗几乎没有影响，对面积的影响也不大。成本、安全性、复杂性等方面的效果好，比较适合在信息安全集成电路特别是算法保密的电路的设计中采用。
权利要求
1.一种信息安全集成电路的可测性与安全性设计方法，其步骤包括(1)根据需要，确定测试的观察点并设计与观察点相对应的电路探测点；(2)采用自动布局布线工具实现观察点和探测点的连接；(3)在测试时，利用探针和电路探测点检测信息安全集成电路的相关信息。
2.如权利要求1所述的信息安全集成电路的可测性与安全性设计方法，其特征在于设置缓冲器电路驱动从探测点到观察点的连线。
3.如权利要求1或2所述的信息安全集成电路的可测性与安全性设计方法，其特征在于探测点设置在压点单元中，作为压点单元的信号点。
全文摘要
本发明提供了一种提高信息安全集成电路的可测性与安全性的方法，属于集成电路设计技术领域。该方法对需要进行观察的测试点通过连线连接到可以用探针进行探测的探测点上，这些探测点和连线没有改变原来的逻辑，在不影响集成电路的可控制性情况下，提高了集成电路的可测试性，同时，由于攻击者对电路结构不了解，因此也难以分析信号的具体含义，采用自动布局布线工具连接观察点和探测点，还将对该集成电路形成冗余设计，给攻击者的反向工程攻击设置了障碍，增强了集成电路的安全性。
文档编号G06F17/50GK1719593SQ200410009319
公开日2006年1月11日 申请日期2004年7月9日 优先权日2004年7月9日
发明者蒋安平, 盛世敏, 刘越, 孙卫 申请人:北京大学